參數(shù)資料
型號： HD6413308
廠商： Hitachi,Ltd.
英文描述： Hitachi Single-Chip MicroComputer
中文描述： 日立單片機
文件頁數(shù)： 59/349頁
文件大小： 1474K
代理商： HD6413308
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Before Execution of BCLR Instruction
Execution of BCLR Instruction
BCLR.B #0, @P4DDR
;clear bit 0 in data direction register
After Execution of BCLR Instruction
P4
7
Input/output
Output Output Output Output Output Output Output Input
Pin state
Low
High
Low
DDR
1
1
1
DR
1
0
0
Pull-up Mos
Off
Off
Off
Explanation:
To execute the BCLR instruction, the CPU begins by reading P4DDR. Since
P4DDR is a write-only register, it is read as H'FF, even though its true value is H'3F.
Next the CPU clears bit 0 of the read data, changing the value to H'FE.
Finally, the CPU writes this value (H'FE) back to P4DDR to complete the BCLR instruction.
As a result, P4
0
DDR is cleared to "0," making P4
0
an input pin. In addition, P4
7
DDR and P4
6
DDR
are set to "1," making P4
7
and P4
6
output pins.
Example 2:
BSET is executed to set bit 0 in the port 4 data register (P4DR) under the following
conditions.
P4
7
:
Input pin, Low, MOS pull-up transistor on
P4
6
:
Input pin, High, MOS pull-up transistor off
P4
5
– P4
0
:
Output pins, Low
The intended purpose of this BSET instruction is to switch the output level at P4
0
from Low to
High.
P4
7
Input
Low
0
1
On
P4
6
Input
High
0
0
Off
P4
5
Output Output Output Output Output Output
Low
Low
Low
1
1
1
0
0
0
Off
Off
Off
P4
4
P4
3
P4
2
P4
1
P4
0
Input/output
Pin state
DDR
DR
Pull-up Mos
Low
1
0
Off
Low
1
0
Off
Low
1
0
Off
P4
6
P4
5
P4
4
P4
3
P4
2
P4
1
P4
0
Low
1
0
Off
Low
1
0
Off
Low
1
0
Off
Low
1
0
Off
High
0
0
Off
43
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