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參數(shù)資料
| 型號： | HD40L4818 |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | 4-Bit Single-Chip Microcomputer(4位單片微計算機) |
| 中文描述： | 4位單片機（4位單片微計算機） |
| 文件頁數(shù)： | 93/98頁 |
| 文件大小： | 621K |
| 代理商： | HD40L4818 |
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HD404818 Series
93
2. The oscillator stabilization time is the period from when V
reaches 2.7 V (HD407L4818: V
CC
=
3.0 V) at power-on until the oscillator stabilizes. The time required to stabilize the oscillator (t
RC
)
must be obtained. Since t
depends on the ceramic oscillator’s circuit constant and stray
capacitance, consult with the ceramic oscillator manufacturer.
3. See figure 48.
4. See figure 49. The unit t
cyc
is applied when the MCU is in standby mode or active mode.
5. See figure 50.
6. See figure 49. The unit t
is applied when the MCU is in watch mode or subactive mode.
t
subcyc
= 244.14
μ
s (when a 32.768-kHz crystal oscillator is used)
7. The analog comparator stabilization time is the period from when D
/D
is placed in analog
input mode until the analog comparator stabilizes and correct data can be read.
8. Applies to HD40L4812, HD40L4814, HD40L4816, and HD40L4818.
9. Applies to HD407L4818.
Serial Interface Timing Characteristics
During Transmit Clock Output (HD40L4812, HD40L4814, HD40L4816, HD40L4818: V
CC
= 2.7 to 6
V; HD407L4818: V
CC
= 3 to 5.5 V; GND = 0 V, T
a
= –20
°
C to +75
°
C, unless otherwise specified)
Item
Symbol
Pin(s)
SCK
Min
Typ
Max
Unit
t
cyc
/
t
subcyc
t
Scyc
Test Condition
Notes
Transmit clock cycle time
t
Scyc
1
1, 2, 4
Transmit clock high and low
widths
t
SCKH
,
t
SCKL
t
SCKr
,
t
SCKf
SCK
0.5
1, 2
Transmit clock rise and fall
times
SCK
200
ns
1, 2
Serial output data delay time t
DSO
Serial input data setup time
SO
500
ns
1, 2
t
SSI
t
HSI
SI
300
ns
1
Serial input data hold time
SI
300
ns
1
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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