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參數(shù)資料
| 型號： | HD404874 |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | Low-Voltage AS Microcomputers with On-Chip LCD Circuit(片上LCD電路的低壓微計算機(jī)) |
| 中文描述： | 低電壓如同在微機(jī)芯片LCD電路（片上液晶顯示器電路的低壓微計算機(jī)） |
| 文件頁數(shù)： | 48/200頁 |
| 文件大小： | 633K |
| 代理商： | HD404874 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁當(dāng)前第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁
HD404889/HD404899/HD404878/HD404868 Series
48
Timer D interrupt request flag (IFTD: $022,2): (Applies to HD404889, HD404899, and HD404878
Series)
The timer D interrupt request flag is set by timer D overflow output, or by an EVND input edge when used
as an input capture timer (table 13).
Table 13
Timer D Interrupt Request Flag (IFTD: $022,2)
Timer D Interrupt Request Flag
(IFTD)
Interrupt Request
0
No timer D interrupt request
1
Timer D interrupt request generated
Timer D interrupt mask (IMTD: $022,3): (Applies to HD404889, HD404899, and HD404878 Series)
This bit masks an interrupt request by the timer D interrupt request flag (table 14).
Table 14
Timer D Interrupt Mask (IMTD: $022,3)
Timer D Interrupt Mask (IMTD)
Interrupt Request
0
Timer D interrupt request enabled
1
Timer D interrupt request masked (held pending)
Serial interrupt request flag (IFS: $023,2):
The serial interrupt request flag is set on completion of serial data transfer, or if data transfer is halted
midway (table 15).
Table 15
Serial Interrupt Request Flag (IFS: $023,2)
Serial Interrupt Request Flag (IFS) Interrupt Request
0
No serial interrupt request
1
Serial interrupt request generated
Serial interrupt mask (IMS: $023,3):
This bit masks an interrupt request by the serial interrupt request flag (table 16).
Table 16
Serial Interrupt Mask (IMS: $023,3)
Serial Interrupt Mask (IMS)
Interrupt Request
0
Serial interrupt request enabled
1
Serial interrupt request masked (held pending)
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