參數(shù)資料
型號(hào)： HD404638R
廠商： Hitachi,Ltd.
英文描述： 4-Bit Single-Chip Microcomputer(4位單片微計(jì)算機(jī))
中文描述： 4位單片機(jī)（4位單片微計(jì)算機(jī)）
文件頁(yè)數(shù)： 9/133頁(yè)
文件大?。?/td> 803K
代理商： HD404638R
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HD404639R Series
9
0
1
2
3
Bit 3
Bit 2
Bit 1
Bit 0
IMTA
(IM of timer A)
IFTA
(IF of timer A)
IM1
(IM of
INT
1
)
IF1
(IF of
INT
1
)
IMTC
(IM of timer C)
IFTC
(IF of timer C)
IMTB
(IM of timer B)
IFTB
(IF of timer B)
IMS1
(IM of serial
interface 1)
IFS1
(IF of serial
interface 1)
IMTD
(IM of timer D)
IFTD
(IF of timer D)
$000
$001
$002
$003
Interrupt control bits area
IM0
(IM of
INT
0
)
IF0
(IF of
INT
0
)
RSP
(Reset SP bit)
IE
(Interrupt
enable flag)
32
33
34
35
ICSF
(Input capture
status flag)
IM3
(IM of
INT
3
)
IF3
(IF of INT
3
)
IM2
(IM of INT
2
)
IF2
(IF of INT
2
)
IMS2
(IM of serial
interface 2)
IFS2
(IF of serial
interface 2)
IM4
(IM of INT )
IF4
(IF of INT )
$020
$021
$022
$023
Register flag area
DTON
(Direct transfer
on flag)
RAME
(RAM enable
flag)
WDON
(Watchdog
on flag)
ICEF
(Input capture
error flag)
LSON
(Low speed
on flag)
Not used
IF:
IM:
IE:
SP:
Interrupt request flag
Interrupt mask
Interrupt enable flag
Stack pointer
Bit 3
Bit 2
Bit 1
Bit 0
4
4
Not used
Figure 3 Configuration of Interrupt Control Bits and Register Flag Areas
IE
IM
LSON
IF
ICSF
ICEF
RAME
RSP
WDON
Not used
DT
SEM/SEMD
REM/REMD
TM/TMD
Allowed
Allowed
Allowed
Not executed
Allowed
Allowed
Not executed
Allowed
Allowed
Not executed
Inhibited
Inhibited
Not executed in active mode
Used in subactive mode
Not executed
Allowed
Allowed
Not executed
Inhibited
Note: WDON is reset by MCU reset or by
STOPC
enable for stop mode cancellation.
DTON is always reset in active mode.
If the TM or TMD instruction is executed for the inhibited bits or non-existing bits,
the value in ST becomes invalid.
Figure 4 Usage Limitations of RAM Bit Manipulation Instructions
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PDF描述
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