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參數(shù)資料
| 型號(hào)： | HD404081 |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | Low-Voltage AS Microcomputers with On-Chip A/D Converter(帶片上A/D轉(zhuǎn)換器的低壓微計(jì)算機(jī)) |
| 中文描述： | 低電壓如同在微機(jī)芯片的A / D轉(zhuǎn)換器（帶片上的A / D轉(zhuǎn)換器的低壓微計(jì)算機(jī)） |
| 文件頁(yè)數(shù)： | 63/162頁(yè) |
| 文件大?。?/td> | 482K |
| 代理商： | HD404081 |
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HD404374/HD404384/HD404389/HD404082/HD404084 Series
63
D Port
The D port consists of 10 I/O pins that are addressed bit-by-bit.
Ports D
0
to D
3
are source large-current I/O pins, and ports D
4
to D
7
are sink large-current I/O pins.
The D port can be set and reset by the SED and RED instructions or the SEDD and REDD instructions.
Output data is stored in the port data register (PDR) for each pin. The entire D port can be tested by the TD
or TDD instruction.
The D port output buffer is turned on and off by the D port data control registers (DCD0 to DCD2: $030 to
$032). The DCD registers are mapped onto memory addresses (figure 25).
Port D
0
is multiplexed as interrupt input pin
INT
0
. Setting as interrupt pin is performed by bit 0 (PMR00)
of port mode register 0 (PMR0: $008) (figure 26).
Data control registers (DCD0–2 : $030–$032)
(DCR0–2, 7 : $034–$036, $03B)
Register Name
DCDn
(n=0 to 2)
DCRm
(m=0 to 2, 7)
Bit
Read/Write
Reset
Bit name
Read/Write
Reset
Bit name
3
W
0
DCDn3
W
0
DCRm3
2
W
0
DCDn2
W
0
DCRm2
1
W
0
DCDn1
W
0
DCRm1
0
W
0
DCDn0
W
0
DCRm0
All bits
0
1
CMOS buffer off (high impedance)
CMOS buffer active
CMOS buffer control
Register Name
DCD0
DCD1
DCD2
DCR0
DCR1
DCR2
DCR7
Bit 3
D
3
D
7
R1
3
R7
3
Bit 2
D
2
D
6
R2
2
R7
2
Bit 1
D
1
D
5
D
9
R2
1
R7
1
Bit 0
D
0
D
4
D
8
R0
0
R1
0
R2
0
R7
0
Correspondence between each bit of DCD and DCR and ports
Figure 25 Data Control Registers (DCD, DCR)
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PDF描述 |
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