參數(shù)資料
型號： H8S2169F-ZTAT
廠商： Renesas Technology Corp.
英文描述： Hitachi 16-Bit Single-Chip Microcomputer
中文描述： 日立16位單片機
文件頁數(shù)： 139/1035頁
文件大小： 4183K
代理商： H8S2169F-ZTAT
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105
Bit n
IRQnF
Description
0
[Clearing conditions]
Cleared by reading IRQnF when set to 1, then writing 0 in IRQnF
When interrupt exception handling is executed while low-level detection is set
(IRQnSCB = IRQnSCA = 0) and
IRQn
input is high
*
When IRQn interrupt exception handling is executed while falling, rising, or both-edge
detection is set (IRQnSCB = 1 or IRQnSCA = 1)
*
(Initial value)
1
[Setting conditions]
When
IRQn
input goes low when low-level detection is set (IRQnSCB = IRQnSCA =
0)
When a falling edge occurs in
IRQn
input while falling edge detection is set
(IRQnSCB = 0, IRQnSCA = 1)
When a rising edge occurs in
IRQn
input while rising edge detection is set
(IRQnSCB = 1, IRQnSCA = 0)
When a falling or rising edge occurs in
IRQn
input while both-edge detection is set
(IRQnSCB = IRQnSCA = 1)
(n = 7 to 0)
Note:
*
When a product, in which a DTC is incorporated, is used in the following settings, the
corresponding flag bit is not automatically cleared even when exception handing, which
is a clear condition, is executed and the bit is held at 1.
(1)
When DTCEA3 is set to 1(ADI is set to an interrupt source), of IRQ4F flag is not
automatically cleared.
(2)
When DTCEA2 is set to 1(ICIA is set to an interrupt source), clearing of IRQ5F flag
is not automatically cleared.
(3)
When DTCEA1 is set to 1(ICIB is set to an interrupt source), clearing of IRQ6F flag
is not automatically cleared.
(4)
When DTCEA0 is set to 1(OCIA is set to an interrupt source), clearing of IRQ7F
flag is not automatically cleared.
When activation interrupt sources of DTC and IRQ interrupts are used with the above
combinations, clear the interrupt flag by software in the interrupt handling routine of the
corresponding IRQ.
5.2.6
Keyboard Matrix Interrupt Mask Register (KMIMR)
7
KMIMR7
1
R/W
6
KMIMR6
0
R/W
5
KMIMR5
1
R/W
4
KMIMR4
1
R/W
3
KMIMR3
1
R/W
0
KMIMR0
1
R/W
2
KMIMR2
1
R/W
1
KMIMR1
1
R/W
Bit
Initial value
Read/Write
KMIMR is an 8-bit readable/writable register that performs mask control for the keyboard matrix
interrupt inputs (pins
KIN7
to
KIN0
) and pin
IRQ6
. To enable key-sense input interrupts from
multiple pin inputs in keyboard matrix scanning/sensing, clear the corresponding mask bits to 0.
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PDF描述
H8S2149F-ZTAT Hitachi 16-Bit Single-Chip Microcomputer
H8S2149 Hitachi 16-Bit Single-Chip Microcomputer
H8S2169 Hitachi 16-Bit Single-Chip Microcomputer
H9000 Peripheral IC
H9100 Peripheral IC
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參數(shù)描述
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