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參數(shù)資料
| 型號： | H8S2145BF-ZTAT |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | Hitachi 16-Bit Single-Chip Microcomputer |
| 中文描述： | 日立16位單片機 |
| 文件頁數(shù)： | 18/829頁 |
| 文件大小： | 4316K |
| 代理商： | H8S2145BF-ZTAT |
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Rev. 2.0, 08/02, page xvi of xxxviii
15.3
Register Descriptions ........................................................................................................341
15.3.1 Receive Shift Register (RSR)...............................................................................342
15.3.2 Receive Data Register (RDR) ..............................................................................342
15.3.3 Transmit Data Register (TDR).............................................................................342
15.3.4 Transmit Shift Register (TSR) .............................................................................342
15.3.5 Serial Mode Register (SMR)................................................................................343
15.3.6 Serial Control Register (SCR)..............................................................................345
15.3.7 Serial Status Register (SSR).................................................................................347
15.3.8 Serial Interface Mode Register (SCMR)..............................................................349
15.3.9 Bit Rate Register (BRR).......................................................................................350
15.3.10 Keyboard Comparator Control Register (KBCOMP)..........................................356
Operation in Asynchronous Mode.....................................................................................357
15.4.1 Data Transfer Format...........................................................................................357
15.4.2 Receive Data Sampling Timing and Reception Margin
in Asynchronous Mode ........................................................................................359
15.4.3 Clock....................................................................................................................360
15.4.4 SCI Initialization (Asynchronous Mode).............................................................361
15.4.5 Data Transmission (Asynchronous Mode)...........................................................362
15.4.6 Serial Data Reception (Asynchronous Mode)......................................................364
Multiprocessor Communication Function.........................................................................368
15.5.1 Multiprocessor Serial Data Transmission ............................................................370
15.5.2 Multiprocessor Serial Data Reception..................................................................371
Operation in Clocked Synchronous Mode ........................................................................374
15.6.1 Clock....................................................................................................................374
15.6.2 SCI Initialization (Clocked Synchronous Mode).................................................375
15.6.3 Serial Data Transmission (Clocked Synchronous Mode).....................................376
15.6.4 Serial Data Reception (Clocked Synchronous Mode)..........................................378
15.6.5 Simultaneous Serial Data Transmission and Reception
(Clocked Synchronous Mode)..............................................................................380
IrDA Operation .................................................................................................................382
Interrupt Sources...............................................................................................................385
Usage Notes.......................................................................................................................386
15.9.1 Module Stop Mode Setting ..................................................................................386
15.9.2 Break Detection and Processing...........................................................................386
15.9.3 Mark State and Break Detection ..........................................................................386
15.9.4 Receive Error Flags and Transmit Operations
(Clocked Synchronous Mode Only).....................................................................386
15.9.5 Relation between Writing to TDR and TDRE Flag .............................................386
15.9.6 Restrictions on Using DTC..................................................................................387
15.9.7 SCI Operations during Mode Transitions.............................................................387
15.9.8 Notes on Switching from SCK Pins to Port Pins..................................................391
15.4
15.5
15.6
15.7
15.8
15.9
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PDF描述 |
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參數(shù)描述 |
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