參數(shù)資料
型號(hào)： GMM27317233ATG-8
英文描述： x72 SDRAM Module
中文描述： x72內(nèi)存模塊
文件頁數(shù)： 8/14頁
文件大小： 169K
代理商： GMM27317233ATG-8
Rev. 1.1/Dec.99
8
GMM27333230ATG
AC Characteristics
(Ta = 0 to 70C, V
CC
, V
CCQ
= 3.3 V +/- 0.3 V, V
SS
, V
SSQ
= 0 V)
Symbol
Unit Notes
t
CK
t
CK
t
CKH
t
CKL
t
AC
t
AC
t
OH
Parameter
System clock
cycle time
(CL=2)
(CL=3)
ns
1
ns
1
CLK high pulse width
ns
1
CLK low pulse width
Access time
from CLK
(CL=2)
(CL=3)
ns
1, 2
ns
1, 2
Data-out hold time
CLK to Data-out low
impedance
CLK to Data-out
high impedance
( CL = 2,3 )
Data-in setup time
t
LZ
ns
1, 2, 3
t
HZ
ns
1, 4
t
DS
t
DH
t
AS
t
AH
t
CES
ns
1
ns
1
Data-in hold time
ns
1
Address setup time
ns
1
Address hold time
ns
1, 5
CKE setup time
CKE setup time for
power down exit
CKE hold time
t
CESP
ns
1
t
CEH
ns
1
t
CS
ns
1
Command (CS, RAS,
CAS, WE, DQM)
setup time
t
RC
ns
1
Ref/Active to Ref/Active
command period
Active to Precharge
command period
Active command to
column command
(same bank)
Precharge to active
command period
t
CH
ns
1
Command (CS, RAS,
CAS, WE, DQM)
hold time
t
RAS
ns
1
t
RCD
ns
1
t
RP
ns
1
- 8
Min
Max
8
-
12
-
- 10K
Min
Max
10
-
15
-
3
-
3
-
3
-
3
-
-
6
-
6
-
8
-
9
3
-
3
-
2
-
2
-
-
6
-
7
2
-
2
-
1
-
1
-
2
-
2
-
1
-
1
-
2
-
2
-
2
-
2
-
1
-
1
-
2
-
2
-
68
-
90
-
1
-
1
-
48
120000
60
120000
20
-
30
-
20
-
30
-
- 7K
Min
Max
10
-
10
-
3
-
3
-
-
6
-
6
3
-
2
-
-
6
2
-
1
-
2
-
1
-
2
-
2
-
1
-
2
-
70
-
1
-
50
120000
20
-
20
-
- 7J
Min
Max
10
-
15
-
3
-
3
-
-
6
-
8
3
-
2
-
-
6
2
-
1
-
2
-
1
-
2
-
2
-
1
-
2
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70
-
1
-
50
120000
20
-
20
-
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