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參數(shù)資料
| 型號(hào)： | GAL22V10B-25QP |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類(lèi)： | PLD |
| 英文描述： | High Performance E2CMOS PLD Generic Array Logic |
| 中文描述： | EE PLD, 25 ns, PDIP24 |
| 封裝： | PLASTIC, DIP-24 |
| 文件頁(yè)數(shù)： | 5/18頁(yè) |
| 文件大小： | 223K |
| 代理商： | GAL22V10B-25QP |
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Specifications
GAL22LV10
5
PLCC Package Pinout
2
26
OLMC
S1
5811
0440
.
.
.
.
0880
3
ASYNCHRONOUS RESET
(TO ALL REGISTERS)
0
4
8
12
16
20
24
28
32
36
40
SYNCHRONOUS PRESET
(TO ALL REGISTERS)
12
0000
5764
0044
.
.
.
0396
27
S0
S1
25
OLMC
S1
5813
0924
.
.
.
.
.
1452
4
5
6
24
OLMC
S1
5815
1496
.
.
.
.
.
.
2112
23
OLMC
S1
5817
2156
.
.
.
.
.
.
.
2860
21
OLMC
S1
5819
2904
.
.
.
.
.
.
.
3608
20
OLMC
S0
S1
3652
.
.
.
.
.
.
4268
OLMC
S1
5823
4312
.
.
.
.
.
4840
10
19
18
OLMC
S1
5825
4884
.
.
.
.
5324
11
5368
.
.
.
5720
17
OLMC
S1
5827
9
7
13
16
8
10
14
16
12
12
16
14
10
8
OLMC
Electronic Signature
5828, 5829 ...
... 5890, 5891
L
S
B
M
S
B
Byte 7 Byte 6 Byte 5 Byte 4
Byte 2 Byte 1 Byte 0
Byte 3
GAL22LV10 Logic Diagram/JEDEC Fuse Map
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| GAL22V10B-7LJ | HEX BIT HOLDER, MAGNETIC 58MM; Length:58mm; Shank Size:1/4" RoHS Compliant: NA |
| GAL22V10B-7LP | High Performance E2CMOS PLD Generic Array Logic |
| GAL22V10B-7LPI | High Performance E2CMOS PLD Generic Array Logic |
| GAL22V10C-15LPI | High Performance E2CMOS PLD Generic Array Logic |
| GAL22V10C-7LJ | High Performance E2CMOS PLD Generic Array Logic |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| GAL22V10B-30LD/883 | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:Electrically-Erasable PLD |
| GAL22V10B-7LJ | 制造商:LATTICE 制造商全稱(chēng):Lattice Semiconductor 功能描述:High Performance E2CMOS PLD Generic Array Logic |
| GAL22V10B-7LP | 制造商:LATTICE 制造商全稱(chēng):Lattice Semiconductor 功能描述:High Performance E2CMOS PLD Generic Array Logic |
| GAL22V10B-7LPI | 制造商:LATTICE 制造商全稱(chēng):Lattice Semiconductor 功能描述:High Performance E2CMOS PLD Generic Array Logic |
| GAL22V10C-10LD/883 | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:Electrically-Erasable PLD |
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