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參數(shù)資料
| 型號： | EVAL-ADUC842QSZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 19/88頁 |
| 文件大小： | 0K |
| 描述： | KIT DEV QUICK START ADUC842 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | QuickStart™ 套件 |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | ADuC824 |
| 所含物品： | 評估板、電源、纜線、軟件和說明文檔 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁當(dāng)前第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁
ADuC841/ADuC842/ADuC843
Rev. 0 | Page 26 of 88
ADCCON3—(ADC Control SFR 3)
The ADCCON3 register controls the operation of various
calibration modes and also indicates the ADC busy status.
SFR Address
F5H
SFR Power-On Default
00H
Bit Addressable
No
Table 9. ADCCON3 SFR Bit Designations
Bit No.
Name
Description
7
BUSY
ADC Busy Status Bit.
A read-only status bit that is set during a valid ADC conversion or during a calibration cycle.
Busy is automatically cleared by the core at the end of conversion or calibration.
6
RSVD
Reserved. This bit should always be written as 0.
5
AVGS1
Number of Average Selection Bits.
This bit selects the number of ADC readings that are averaged during a calibration cycle.
4
AVGS0
AVGS1
0
1
AVGS0
0
1
0
1
Number of Averages
15
1
31
63
3
RSVD
Reserved. This bit should always be written as 0.
2
RSVD
This bit should always be written as 1 by the user when performing calibration.
1
TYPICAL
Calibration Type Select Bit.
This bit selects between offset (zero-scale) and gain (full-scale) calibration.
Set to 0 for offset calibration.
Set to 1 for gain calibration.
0
SCAL
Start Calibration Cycle Bit.
When set, this bit starts the selected calibration cycle.
It is automatically cleared when the calibration cycle is completed.
相關(guān)PDF資料 |
PDF描述 |
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| EVAL-ADUC846QS | 制造商:AD 制造商全稱:Analog Devices 功能描述:MicroConverter, Dual 16-Bit ADCs with Embedded 62kB FLASH MCU |
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