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參數(shù)資料
| 型號： | EPM7160S |
| 廠商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family |
| 中文描述： | 可編程邏輯器件系列 |
| 文件頁數(shù)： | 29/62頁 |
| 文件大?。?/td> | 1173K |
| 代理商： | EPM7160S |
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Altera Corporation
29
MAX 7000 Programmable Logic Device Family Data Sheet
Table 17. MAX 7000 & MAX 7000E Internal Timing Parameters
Note (1)
Symbol
Parameter
Conditions
Speed Grade -6
Speed Grade -7
Unit
Min
Max
Min
Max
t
IN
t
IO
t
FIN
t
SEXP
t
PEXP
t
LAD
t
LAC
t
IOE
t
OD1
Input pad and buffer delay
0.4
0.5
ns
I/O input pad and buffer delay
0.4
0.5
ns
Fast input delay
(2)
0.8
1.0
ns
Shared expander delay
3.5
4.0
ns
Parallel expander delay
0.8
0.8
ns
Logic array delay
2.0
3.0
ns
Logic control array delay
2.0
3.0
ns
Internal output enable delay
(2)
2.0
ns
Output buffer and pad delay
Slow slew rate = off, V
CCIO
= 5.0 V
Output buffer and pad delay
Slow slew rate = off, V
CCIO
= 3.3 V
Output buffer and pad delay
Slow slew rate = on,
V
CCIO
= 5.0 V or 3.3 V
Output buffer enable delay
Slow slew rate = off, V
CCIO
= 5.0 V
Output buffer enable delay
Slow slew rate = off, V
CCIO
= 3.3 V
Output buffer enable delay
Slow slew rate = on
V
CCIO
= 5.0 V or 3.3 V
Output buffer disable delay
C1 = 35 pF
2.0
2.0
ns
t
OD2
C1 = 35 pF
(7)
2.5
2.5
ns
t
OD3
C1 = 35 pF
(2)
7.0
7.0
ns
t
ZX1
C1 = 35 pF
4.0
4.0
ns
t
ZX2
C1 = 35 pF
(7)
4.5
4.5
ns
t
ZX3
C1 = 35 pF
(2)
9.0
9.0
ns
t
XZ
t
SU
t
H
t
FSU
t
FH
t
RD
t
COMB
t
IC
t
EN
t
GLOB
t
PRE
t
CLR
t
PIA
t
LPA
C1 = 5 pF
4.0
4.0
ns
Register setup time
3.0
3.0
ns
Register hold time
1.5
2.0
ns
Register setup time of fast input
(2)
2.5
3.0
ns
Register hold time of fast input
(2)
0.5
0.5
ns
Register delay
0.8
1.0
ns
Combinatorial delay
0.8
1.0
ns
Array clock delay
2.5
3.0
ns
Register enable time
2.0
3.0
ns
Global control delay
0.8
1.0
ns
Register preset time
2.0
2.0
ns
Register clear time
2.0
2.0
ns
PIA delay
0.8
1.0
ns
Low-power adder
(8)
10.0
10.0
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EPM7192E | Programmable Logic Device Family |
| EPM7192S | Programmable Logic Device Family |
| EPM7256E | Programmable Logic Device Family |
| EPM7256S | Programmable Logic Device Family |
| EPM7096LC68-12 | Programmable Logic Device Family |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| EPM7160SLC8410N | 制造商:Altera Corporation 功能描述:PROGRAMMABLE LOGIC DEVICE |
| EPM7160SLC84-10N | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 160 Macro 64 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| EPM7160SLC84-6 | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 160 Macro 64 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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