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參數(shù)資料
| 型號： | EPM7128SLC84-10 |
| 廠商： | Altera |
| 文件頁數(shù)： | 12/66頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAX 7000 CPLD 128 84-PLCC |
| 標準包裝： | 75 |
| 系列： | MAX® 7000 |
| 可編程類型： | 系統(tǒng)內可編程 |
| 最大延遲時間 tpd(1)： | 10.0ns |
| 電壓電源 - 內部： | 4.75 V ~ 5.25 V |
| 邏輯元件/邏輯塊數(shù)目： | 8 |
| 宏單元數(shù)： | 128 |
| 門數(shù)： | 2500 |
| 輸入/輸出數(shù)： | 68 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 84-LCC（J 形引線） |
| 供應商設備封裝： | 84-PLCC（29.31x29.31） |
| 包裝： | 托盤 |
| 產品目錄頁面： | 604 (CN2011-ZH PDF) |
| 其它名稱： | 544-1207-5 |
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2
Altera Corporation
MAX 7000 Programmable Logic Device Family Data Sheet
...and More
Features
■
Open-drain output option in MAX 7000S devices
■
Programmable macrocell flipflops with individual clear, preset,
clock, and clock enable controls
■
Programmable power-saving mode for a reduction of over 50% in
each macrocell
■
Configurable expander product-term distribution, allowing up to
32 product terms per macrocell
■
44 to 208 pins available in plastic J-lead chip carrier (PLCC), ceramic
pin-grid array (PGA), plastic quad flat pack (PQFP), power quad flat
pack (RQFP), and 1.0-mm thin quad flat pack (TQFP) packages
■
Programmable security bit for protection of proprietary designs
■
3.3-V or 5.0-V operation
–MultiVoltTM I/O interface operation, allowing devices to
interface with 3.3-V or 5.0-V devices (MultiVolt I/O operation is
not available in 44-pin packages)
–
Pin compatible with low-voltage MAX 7000A and MAX 7000B
devices
■
Enhanced features available in MAX 7000E and MAX 7000S devices
–
Six pin- or logic-driven output enable signals
–
Two global clock signals with optional inversion
–
Enhanced interconnect resources for improved routability
–
Fast input setup times provided by a dedicated path from I/O
pin to macrocell registers
–
Programmable output slew-rate control
■
Software design support and automatic place-and-route provided by
Altera’s development system for Windows-based PCs and Sun
SPARCstation, and HP 9000 Series 700/800 workstations
Table 2. MAX 7000S Device Features
Feature
EPM7032S
EPM7064S
EPM7128S
EPM7160S
EPM7192S
EPM7256S
Usable gates
600
1,250
2,500
3,200
3,750
5,000
Macrocells
32
64
128
160
192
256
Logic array
blocks
24
8
10
12
16
Maximum
user I/O pins
36
68
100
104
124
164
tPD (ns)
5
6
7.5
tSU (ns)
2.9
3.4
4.1
3.9
tFSU (ns)
2.5
3
tCO1 (ns)
3.2
4
3.9
4.7
fCNT (MHz)
175.4
147.1
149.3
125.0
128.2
相關PDF資料 |
PDF描述 |
|---|---|
| GEC28DREH-S13 | CONN EDGECARD 56POS .100 EXTEND |
| TIM106M035P0Y | CAP TANT 10UF 35V 20% RADIAL |
| EPM2210F256C5N | IC MAX II CPLD 2210 LE 256-FBGA |
| TIM396M010P0Y | CAP TANT 39UF 10V 20% RADIAL |
| MAX1589AEZT250+T | IC REG LDO 2.5V .5A 6TSOT |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| EPM7128SLC84-10N | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 128 Macro 68 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| EPM7128SLC84-15 | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 128 Macro 68 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| EPM7128SLC84-15 | 制造商:Altera Corporation 功能描述:MAX DEVICE |
| EPM7128SLC84-15N | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 128 Macro 68 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| EPM7128SLC84-15N | 制造商:Altera Corporation 功能描述:PROGRAMMABLE LOGIC IC |
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