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參數(shù)資料
| 型號(hào)： | EPM7128AE |
| 廠商： | Altera Corporation |
| 英文描述： | Programmable Logic Device |
| 中文描述： | 可編程邏輯器件 |
| 文件頁數(shù)： | 43/60頁 |
| 文件大?。?/td> | 943K |
| 代理商： | EPM7128AE |
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Altera Corporation
43
MAX 7000A Programmable Logic Device Data Sheet
Table 23. EPM7512AE Internal Timing Parameters (Part 1 of 2)
Note (1)
Symbol
Parameter
Conditions
Speed Grade
Unit
-7
-10
-12
Min
Max
Min
Max
Min
Max
t
IN
t
IO
Input pad and buffer delay
I/O input pad and buffer
delay
Fast input delay
Shared expander delay
Parallel expander delay
Logic array delay
Logic control array delay
Internal output enable delay
Output buffer and pad
delay, slow slew rate = off
V
CCIO
= 3.3 V
Output buffer and pad
delay, slow slew rate = off
V
CCIO
= 2.5 V
Output buffer and pad
delay, slow slew rate = on
V
CCIO
= 2.5 V or 3.3 V
Output buffer enable delay,
slow slew rate = off
V
CCIO
= 3.3 V
Output buffer enable delay,
slow slew rate = off
V
CCIO
= 2.5 V
Output buffer enable delay,
slow slew rate = on
V
CCIO
= 3.3 V
Output buffer disable delay
Register setup time
Register hold time
Register setup time of fast
input
Register hold time of fast
input
Register delay
Combinatorial delay
Array clock delay
0.7
0.7
0.9
0.9
1.0
1.0
ns
ns
t
FIN
t
SEXP
t
PEXP
t
LAD
t
LAC
t
IOE
t
OD1
3.1
2.7
0.4
2.2
1.0
0.0
1.0
3.6
3.5
0.5
2.8
1.3
0.0
1.5
4.1
4.4
0.6
3.5
1.7
0.0
1.7
ns
ns
ns
ns
ns
ns
ns
C1 = 35 pF
t
OD2
C1 = 35 pF
(5)
1.5
2.0
2.2
ns
t
OD3
C1 = 35 pF
6.0
6.5
6.7
ns
t
ZX1
C1 = 35 pF
4.0
5.0
5.0
ns
t
ZX2
C1 = 35 pF
(5)
4.5
5.5
5.5
ns
t
ZX3
C1 = 35 pF
9.0
10.0
10.0
ns
t
XZ
t
SU
t
H
t
FSU
C1 = 5 pF
4.0
5.0
5.0
ns
ns
ns
ns
2.1
0.6
1.6
3.0
0.8
1.6
3.5
1.0
1.6
t
FH
1.4
1.4
1.4
ns
t
RD
t
COMB
t
IC
1.3
0.6
1.8
1.7
0.8
2.3
2.1
1.0
2.9
ns
ns
ns
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