參數(shù)資料
型號： EPM7064STC100-6F
廠商： Altera
文件頁數(shù)： 32/66頁
文件大?。?/td> 0K
描述： IC MAX 7000 CPLD 64 100-TQFP
標準包裝： 90
系列： MAX® 7000
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 6.0ns
電壓電源 - 內(nèi)部： 4.75 V ~ 5.25 V
邏輯元件/邏輯塊數(shù)目： 4
宏單元數(shù)： 64
門數(shù)： 1250
輸入/輸出數(shù)： 68
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 100-TQFP
供應商設備封裝： 100-TQFP（14x14）
包裝： 托盤
38
Altera Corporation
MAX 7000 Programmable Logic Device Family Data Sheet
Table 26. MAX 7000 & MAX 7000E Internal Timing Parameters
Symbol
Parameter
Conditions
Speed Grade
Unit
-15
-15T
-20
Min
Max
Min
Max
Min
Max
tIN
Input pad and buffer delay
2.0
3.0
ns
tIO
I/O input pad and buffer delay
2.0
3.0
ns
tFIN
Fast input delay
2.0–4.0
ns
tSEXP
Shared expander delay
8.0
10.0
9.0
ns
tPEXP
Parallel expander delay
1.0
2.0
ns
tLAD
Logic array delay
6.0
8.0
ns
tLAC
Logic control array delay
6.0
8.0
ns
tIOE
Internal output enable delay
3.0–4.0
ns
tOD1
Output buffer and pad delay
Slow slew rate = off
VCCIO = 5.0 V
C1 = 35 pF
4.0
5.0
ns
tOD2
Output buffer and pad delay
Slow slew rate = off
VCCIO = 3.3 V
C1 = 35 pF (7)
5.0–6.0
ns
tOD3
Output buffer and pad delay
Slow slew rate = on
VCCIO = 5.0 V or 3.3 V
C1 = 35 pF (2)
8.0–9.0
ns
tZX1
Output buffer enable delay
Slow slew rate = off
VCCIO = 5.0 V
C1 = 35 pF
6.0
10.0
ns
tZX2
Output buffer enable delay
Slow slew rate = off
VCCIO = 3.3 V
C1 = 35 pF (7)
7.0
–
11.0
ns
tZX3
Output buffer enable delay
Slow slew rate = on
VCCIO = 5.0 V or 3.3 V
C1 = 35 pF (2)
10.0
–
14.0
ns
tXZ
Output buffer disable delay
C1 = 5 pF
6.0
10.0
ns
tSU
Register setup time
4.0
ns
tH
Register hold time
4.0
5.0
ns
tFSU
Register setup time of fast input (2)
2.0–4.0
ns
tFH
Register hold time of fast input
2.0–3.0
ns
tRD
Register delay
1.0
ns
tCOMB
Combinatorial delay
1.0
ns
tIC
Array clock delay
6.0
8.0
ns
tEN
Register enable time
6.0
8.0
ns
tGLOB
Global control delay
1.0
3.0
ns
tPRE
Register preset time
4.0
ns
tCLR
Register clear time
4.0
ns
tPIA
PIA delay
2.0
3.0
ns
tLPA
Low-power adder
13.0
15.0
ns
相關PDF資料
PDF描述
VI-25N-CY-F2 CONVERTER MOD DC/DC 18.5V 50W
MIC5255-3.0BD5 TR IC REG LDO 3V .15A TSOT23-5
VI-B01-CY-F2 CONVERTER MOD DC/DC 12V 50W
RBM02DRUN CONN EDGECARD 4POS DIP .156 SLD
V375A2E160BL3 CONVERTER MOD DC/DC 2V 160W
相關代理商/技術參數(shù)
參數(shù)描述
EPM7064STC100-7 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 64 Macro 68 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
EPM7064STC100-7N 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 64 Macro 68 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
EPM7064STC44-10 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 64 Macro 36 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
EPM7064STC44-10F 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 64 Macro 36 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
EPM7064STC44-10FN 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 64 Macro 36 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
發(fā)布緊急采購，3分鐘左右您將得到回復。

采購需求

(若只采購一條型號，填寫一行即可)

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

*型號 *數(shù)量 廠商 批號 封裝
添加更多采購

我的聯(lián)系方式

*
*
*