參數(shù)資料
| 型號： | EPF10K30ABC356-1 |
| 廠商： | Altera |
| 文件頁數(shù)： | 44/128頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FLEX 10K FPGA 30K 356-BGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 24 |
| 系列： | FLEX-10K® |
| LAB/CLB數(shù)： | 216 |
| 邏輯元件/單元數(shù)： | 1728 |
| RAM 位總計： | 12288 |
| 輸入/輸出數(shù)： | 246 |
| 門數(shù)： | 69000 |
| 電源電壓： | 3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 356-BGA |
| 供應商設備封裝： | 356-BGA（35x35） |
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Altera Corporation
FLEX 10K Embedded Programmable Logic Device Family Data Sheet
During compilation, the Compiler automatically selects the best control
signal implementation. Because the clear and preset functions are active-
low, the Compiler automatically assigns a logic high to an unused clear or
preset.
The clear and preset logic is implemented in one of the following six
modes chosen during design entry:
■
Asynchronous clear
■
Asynchronous preset
■
Asynchronous clear and preset
■
Asynchronous load with clear
■
Asynchronous load with preset
■
Asynchronous load without clear or preset
In addition to the six clear and preset modes, FLEX 10K devices provide a
chip-wide reset pin that can reset all registers in the device. Use of this
feature is set during design entry. In any of the clear and preset modes, the
chip-wide reset overrides all other signals. Registers with asynchronous
presets may be preset when the chip-wide reset is asserted. Inversion can
be used to implement the asynchronous preset. Figure 10 shows examples
of how to enter a section of a design for the desired functionality.
相關PDF資料 |
PDF描述 |
|---|---|
| AMC31DREI-S93 | CONN EDGECARD 62POS .100 EYELET |
| 25LC080D-I/MS | IC SRL EEPROM 1KX8 2.5V 8-MSOP |
| 25AA080B-I/ST | IC EEPROM 8KBIT 10MHZ 8TSSOP |
| 5-212534-1 | CONN D-SUB RCPT HSING 21C4 MIX |
| RBB105DHBS | CONN EDGECARD 210PS R/A .050 DIP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| EPF10K30ABC3562 | 制造商:ALTERA 功能描述:New |
| EPF10K30ABC356-2 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Flex 10K 216 LABs 246 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EPF10K30ABC356-3 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Flex 10K 216 LABs 246 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EPF10K30ABI356-3 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Altera Corporation 功能描述: |
| EPF10K30AFC256-1 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Flex 10K 216 LABs 191 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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