參數(shù)資料
型號(hào)： EP4SGX530KH40I4N
廠商： Altera
文件頁數(shù)： 71/82頁
文件大?。?/td> 0K
描述： IC STRATIX IV FPGA 530K 1517HBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 3
系列： Stratix® IV GX
LAB/CLB數(shù)： 21248
邏輯元件/單元數(shù)： 531200
RAM 位總計(jì)： 28033024
輸入/輸出數(shù)： 744
電源電壓： 0.87 V ~ 0.93 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 1517-BBGA 裸露焊盤
供應(yīng)商設(shè)備封裝： 1517-HBGA（42.5x42.5）
Chapter 1: DC and Switching Characteristics for Stratix IV Devices
1–65
Glossary
March 2014
Altera Corporation
Stratix IV Device Handbook
Volume 4: Device Datasheet and Addendum
J
J
High-speed I/O block: Deserialization factor (width of parallel data bus).
JTAG Timing
Specifications
JTAG Timing Specifications:
K, L,
M, N, O
——
P
PLL
Specifications
Diagram of PLL Specifications (1)
Note:
(1) Core Clock can only be fed by dedicated clock input pins or PLL outputs.
Q
——
RRL
Receiver differential input discrete resistor (external to Stratix IV device).
Table 1–54. Glossary Table (Part 2 of 4)
Letter
Subject
Definitions
TDO
TCK
tJPZX
t
JPCO
tJPH
t JPXZ
tJCP
tJPSU
t JCL
tJCH
TDI
TMS
Core Clock
External Feedback
Reconfigurable in User Mode
Key
CLK
N
M
PFD
Switchover
VCO
CP
LF
CLKOUT Pins
GCLK
RCLK
fINPFD
fIN
fVCO
fOUT
fOUT_EXT
Counters
C0..C9
相關(guān)PDF資料
PDF描述
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93LC46BT-E/MNY IC EEPROM SER 1K 2.5V 8TDFN
EP4SGX530KH40C3N IC STRATIX IV GX 530K 1517HBGA
24LC025T-E/SN IC EEPROM 2KBIT 400KHZ 8SOIC
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參數(shù)描述
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