參數(shù)資料
型號： EP4SGX180FF35I3N
廠商： Altera
文件頁數(shù)： 31/82頁
文件大?。?/td> 0K
描述： IC STRATIX IV FPGA 180K 1152FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 3
系列： Stratix® IV GX
LAB/CLB數(shù)： 7030
邏輯元件/單元數(shù)： 175750
RAM 位總計(jì)： 13954048
輸入/輸出數(shù)： 564
電源電壓： 0.87 V ~ 0.93 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 1152-BBGA
供應(yīng)商設(shè)備封裝： 1152-FBGA（27x27）
Chapter 1: DC and Switching Characteristics for Stratix IV Devices
1–29
Switching Characteristics
March 2014
Altera Corporation
Stratix IV Device Handbook
Volume 4: Device Datasheet and Addendum
AEQ Data Rate
min VID
(diff p-p)
outer envelope
= 600 mV
8B/10B
encoded data
2500
—
6500
2500
—
6500
—
Mbps
Decision Feedback
Equalizer (DFE) Data
Rate
min VID
(diff p-p)
outer envelope
= 600 mV
3125
—
6500
3125
—
6500
—
Mbps
Transmitter
Supported I/O
Standards
1.4 V PCML
Data rate (Single
width,
non-PMA Direct)
—
600
—
3750
600
—
3750
600
—
3750
Mbps
Data rate (Double
width,
non-PMA Direct)
—
1000
—
11300
1000
—
10312.5 1000
—
8500
Mbps
Data rate (Single
width,
PMA Direct)
—
600
—
3250
600
—
3250
600
—
3250
Mbps
Data rate (Double
width,
PMA Direct) (12)
—
1000
—
6500
1000
—
6500
1000
—
6500
Mbps
VOCM
0.65 V setting
—
650
—
650
—
650
—
mV
Differential on-chip
termination
resistors
85
setting
85 ± 15%
100
setting
100 ± 15%
120
setting
120 ± 15%
150-
setting
150 ± 15%
Table 1–24. Transceiver Specifications for Stratix IV GT Devices (Part 5 of 8)
Symbol/
Description
Conditions
–1 Industrial Speed
Grade
–2 Industrial Speed
Grade
–3 Industrial Speed
Grade
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
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PDF描述
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