參數(shù)資料
型號： EP4CE15F17I8LN
廠商： Altera
文件頁數(shù)： 15/42頁
文件大?。?/td> 0K
描述： IC CYCLONE IV E FPGA 15K 256FBGA
產(chǎn)品培訓(xùn)模塊： Designing an IP Surveillance Camera
Three Reasons to Use FPGA's in Industrial Designs
Cyclone IV FPGA Family Overview
特色產(chǎn)品： Cyclone? IV FPGAs
標(biāo)準(zhǔn)包裝： 90
系列： CYCLONE® IV E
LAB/CLB數(shù)： 963
邏輯元件/單元數(shù)： 15408
RAM 位總計(jì)： 516096
輸入/輸出數(shù)： 165
電源電壓： 0.97 V ~ 1.03 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 256-BGA
供應(yīng)商設(shè)備封裝： 256-FBGA（17x17）
其它名稱： 544-2663
1–22
Chapter 1: Cyclone IV Device Datasheet
Switching Characteristics
December 2013
Altera Corporation
Figure 1–4 shows the differential receiver input waveform.
Figure 1–5 shows the transmitter output waveform.
Table 1–22 lists the typical VOD for Tx term that equals 100 .
Figure 1–4. Receiver Input Waveform
Single-Ended Waveform
Differential Waveform
VID (diff peak-peak) = 2 x VID (single-ended)
Positive Channel (p)
Negative Channel (n)
Ground
VID
p
n = 0 V
VCM
Figure 1–5. Transmitter Output Waveform
Single-Ended Waveform
Differential Waveform
VOD (diff peak-peak) = 2 x VOD (single-ended)
Positive Channel (p)
Negative Channel (n)
Ground
VOD
p
n = 0 V
VCM
Table 1–22. Typical VOD Setting, Tx Term = 100
Symbol
VOD Setting (mV)
12
3
4 (1)
56
VOD differential peak
to peak typical (mV)
400
600
800
900
1000
1200
Note to Table 1–22:
(1) This setting is required for compliance with the PCIe protocol.
相關(guān)PDF資料
PDF描述
TPSD107K020R0150 CAP TANT 100UF 20V 10% 2917
VJ1206A620KBBAT4X CAP CER 62PF 100V 10% NP0 1206
ECM22DCMD CONN EDGECARD 44POS .156 WW
1N457TR DIODE SS 70V 200MA DO35
TAJY157K006RNJ CAP TANT 150UF 6.3V 10% 2917
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參數(shù)描述
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