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參數(shù)資料
型號： EP2SGX90FF1508C3
廠商： Altera
文件頁數(shù)： 1317/1486頁
文件大?。?/td> 0K
描述： IC STRATIX II GX 90K 1508-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 7
系列： Stratix® II GX
LAB/CLB數(shù)： 4548
邏輯元件/單元數(shù)： 90960
RAM 位總計： 4520448
輸入/輸出數(shù)： 650
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 1508-BBGA
供應(yīng)商設(shè)備封裝： 1508-FBGA（30x30）
配用： 544-1725-ND - PCIE KIT W/S II GX EP2SGX90N
544-1724-ND - SI KIT W/SII GX EP2SGX90N
544-1702-ND - VIDEO KIT W/SII GX EP2SGX90N
其它名稱： 544-1769
EP2SGX90FF1508C3ES
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Altera Corporation
Stratix II GX Device Handbook, Volume 2
October 2007
SONET/SDH Mode
Create pll_locked port to
indicate PLL is in lock with the
reference input clock
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Device Handbook for information about this port.
Clock Multiplier Unit
section in the
chapter in volume 2 of the
Stratix II GX Device
Handbook.
Create rx_locktorefclk
port to lock the RX PLL to the
reference clock
Overview chapter in volume 2 of the Stratix II GX
Device Handbook for information about this port.
Clock Recovery Unit
section in the
chapter in volume 2 of the
Stratix II GX Device
Handbook.
Create rx_locktodata port
to lock the RX PLL to the
received data
Overview chapter in volume 2 of the Stratix II GX
Device Handbook for information about this port.
Clock Recovery Unit
section in the
chapter in volume 2 of the
Stratix II GX Device
Handbook.
Create rx_pll_locked port
to indicate RX PLL is in lock with
the reference clock
Overview chapter in volume 2 of the Stratix II GX
Device Handbook for information about this port.
Clock Recovery Unit
section in the
chapter in volume 2 of the
Stratix II GX Device
Handbook.
Create rx_freqlocked port
to indicate RX PLL is in lock with
the received data
Overview chapter in volume 2 of the Stratix II GX
Device Handbook for information about this port.
Clock Recovery Unit
section in the
chapter in volume 2 of the
Stratix II GX Device
Handbook.
Create rx_signaldetect
port to indicate data input signal
detection
Overview chapter in volume 2 of the Stratix II GX
Device Handbook for information about this port.
Receiver Buffer section in
Overview chapter in
volume 2 of the
Stratix II GX Device
Handbook.
Table 4–38. MegaWizard Plug-In Manager Options (Page 4 for SONET/SDH Mode) (Part 2 of 3)
ALT2GXB Setting
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相關(guān)PDF資料
PDF描述
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ASC49DREI-S93 CONN EDGECARD 98POS .100 EYELET
EP4SGX180KF40I4N IC STRATIX IV FPGA 180K 1517FBGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
EP2SGX90FF1508C3N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II GX 4548 LABs 650 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX90FF1508C4 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II GX 4548 LABs 650 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX90FF1508C4ES 制造商:Altera Corporation 功能描述:
EP2SGX90FF1508C4N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II GX 4548 LABs 650 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX90FF1508C5 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II GX 4548 LABs 650 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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