參數(shù)資料
型號(hào)： EP2SGX60CF780C3
廠商： Altera
文件頁(yè)數(shù)： 1129/1486頁(yè)
文件大?。?/td> 0K
描述： IC STRATIX II GX 60K 780-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 9
系列： Stratix® II GX
LAB/CLB數(shù)： 3022
邏輯元件/單元數(shù)： 60440
RAM 位總計(jì)： 2544192
輸入/輸出數(shù)： 364
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 780-BBGA
供應(yīng)商設(shè)備封裝： 780-FBGA（29x29）
其它名稱： 544-1755
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Altera Corporation
3–87
October 2007
Stratix II GX Device Handbook, Volume 2
Stratix II GX Dynamic Reconfiguration
1.
Set the reconfig_mode_sel signal to 001. Write the default
.hex
/.mif file contents for two reconfig_address_out signal
increments. That is, pulse the write_all signal for the
reconfig_address_out 0
and 1 based on the busy and
reconfig_address_en
signals.
2.
The .hex/.mif file selected for writing should correspond to the
default configuration in the ALT2GXB MegaWizard. For example, if
you have two .hex/.mif files that correspond to GIGE and
SONET/SDH OC48 protocols, and if you have set GIGE as your
default configuration (the protocol set in the General tab of the
ALT2GXB MegaWizard), write the first two words of the .hex/.mif
file generated for GIGE protocol.
3.
After you complete writing the first two words, wait for the busy
signal to go low and assert the reset_reconfig_address signal
to initialize the reconfig_address_out to 0.
Channel and
Clock Multiplier
Unit (CMU) PLL
Reconfiguration
Introduction
The Stratix II GX transceiver can be dynamically reconfigured to various
protocols and data rates. This section discusses the dynamic
reconfiguration features introduced in Quartus II software version 7.1.
Altera assumes you have prior knowledge about the dynamic
reconfiguration controller architecture (refer to “Dynamic
transceiver architecture, and the memory initialization file (.mif, also
page 3–32) for dynamic reconfiguration.
Synopsis of Existing Dynamic Reconfiguration Features
In the Quartus II software version 7.0 and earlier, the following dynamic
reconfiguration features were available:
■
PMA reconfiguration—to control voltage output differential (VOD),
pre-emphasis, equalization, and DC gain.
■
Channel reconfiguration—to dynamically reconfigure the
transceiver data rates, protocol modes, or a combination of these two
options. This method requires a MIF to reconfigure a channel.
■
Dynamic transmit rate switch—to dynamically reconfigure the
transmit data rate by changing the local divider settings in the
transmit side. The available local divider options are by /1, /2, or /4.
This method does not require a MIF for reconfiguration.
1
This option can only change the transmitter data rate and not the
receiver data rate.
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PDF描述
AGM36DTBS CONN EDGECARD 72POS R/A .156 SLD
EP1SGX25DF672C5N IC STRATIX GX FPGA 25K 672-FBGA
24LC02B-I/MS IC EEPROM 2KBIT 400KHZ 8MSOP
24LC01B-E/SN IC EEPROM 1KBIT 400KHZ 8SOIC
93LC46AT/ST IC EEPROM 1KBIT 2MHZ 8TSSOP
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
EP2SGX60CF780C3N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II GX 3022 LABs 364 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX60CF780C4 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II GX 3022 LABs 364 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX60CF780C4N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II GX 3022 LABs 364 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX60CF780C5 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II GX 3022 LABs 364 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2SGX60CF780C5N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II GX 3022 LABs 364 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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