參數(shù)資料
型號(hào)： EP2SGX30DF780C4
廠商： Altera
文件頁(yè)數(shù)： 545/1486頁(yè)
文件大?。?/td> 0K
描述： IC STRATIX II GX 30K 780-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 9
系列： Stratix® II GX
LAB/CLB數(shù)： 1694
邏輯元件/單元數(shù)： 33880
RAM 位總計(jì)： 1369728
輸入/輸出數(shù)： 361
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 780-BBGA
供應(yīng)商設(shè)備封裝： 780-FBGA（29x29）
其它名稱： 544-1752
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2–132
Altera Corporation
Stratix II GX Device Handbook, Volume 1
October 2007
I/O Structure
f
For more information on tolerance specifications for differential on-chip
termination, refer to the DC & Switching Characteristics chapter in
volume 1 of the Stratix II GX Device Handbook.
On-Chip Series Termination without Calibration
Stratix II GX devices support driver impedance matching to provide the
I/O driver with controlled output impedance that closely matches the
impedance of the transmission line. As a result, reflections can be
significantly reduced. Stratix II GX devices support on-chip series
termination for single-ended I/O standards with typical RS values of
25 and 50
Ω. Once matching impedance is selected, current drive
strength is no longer selectable. Table 2–34 shows the list of output
standards that support on-chip series termination without calibration.
f
For more information about series on-chip termination supported by
Stratix II GX devices, refer to the Selectable I/O Standards in Stratix II &
Stratix II GX Devices chapter in volume 2 of the Stratix II GX Device
Handbook.
f
For more information about tolerance specifications for on-chip
termination without calibration, refer to the DC & Switching
Characteristics chapter in volume 1 of the Stratix II GX Device Handbook.
On-Chip Series Termination with Calibration
Stratix II GX devices support on-chip series termination with calibration
in column I/O pins in top and bottom banks. There is one calibration
circuit for the top I/O banks and one circuit for the bottom I/O banks.
Each on-chip series termination calibration circuit compares the total
impedance of each I/O buffer to the external 25-
Ωor 50-Ω resistors
connected to the RUP and RDN pins, and dynamically enables or disables
the transistors until they match. Calibration occurs at the end of device
configuration. Once the calibration circuit finds the correct impedance, it
powers down and stops changing the characteristics of the drivers.
f
For more information about series on-chip termination supported by
Stratix II GX devices, refer to the Selectable I/O Standards in Stratix II &
Stratix II GX Devices chapter in volume 2 of the Stratix II GX Device
Handbook.
f
For more information about tolerance specifications for on-chip
termination with calibration, refer to the DC & Switching Characteristics
chapter in volume 1 of the Stratix II GX Device Handbook.
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PDF描述
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