參數(shù)資料
型號： EP2SGX130GF1508C4N
廠商： Altera
文件頁數(shù)： 271/1486頁
文件大小： 0K
描述： IC STRATIX II GX 130K 1508-FBGA
產品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 7
系列： Stratix® II GX
LAB/CLB數(shù)： 6627
邏輯元件/單元數(shù)： 132540
RAM 位總計： 6747840
輸入/輸出數(shù)： 734
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1508-BBGA
供應商設備封裝： 1508-FBGA（30x30）
其它名稱： 544-1925
EP2SGX130GF1508C4N-ND
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Altera Corporation
11–7
October 2007
Stratix II GX Device Handbook, Volume 2
High-Speed Differential I/O Interfaces with DPA in Stratix II & Stratix II GX Devices
other phase shifts in 45° increments. These settings are made statically in
the Quartus II MegaWizard software. Figure 11–4 shows the transmitter
in clock output mode.
Figure 11–4. Transmitter in Clock Output Mode
The serializer can be bypassed to support DDR (
× 2) and SDR (× 1)
operations. The I/O element (IOE) contains two data output registers that
each can operate in either DDR or SDR mode. The clock source for the
registers in the IOE can come from any routing resource, from the fast
PLL, or from the enhanced PLL. Figure 11–5 shows the bypass path.
Figure 11–5. Serializer Bypass
Transmitter Circuit
diffioclk
load_en
Parallel
Series
Internal
Logic
tx_outclock
IOE
Serializer
Internal Logic
IOE Supports SDR, DDR, or
Non-Registered Data Path
Not used (connection exists)
tx_out
相關PDF資料
PDF描述
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相關代理商/技術參數(shù)
參數(shù)描述
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EP2SGX130GF1508I4 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II GX 6627 LABs 734 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
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