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參數(shù)資料
| 型號： | EP2S60F672C5N |
| 廠商： | Altera |
| 文件頁數(shù)： | 58/768頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX II FPGA 60K 672-FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 10 |
| 系列： | Stratix® II |
| LAB/CLB數(shù)： | 3022 |
| 邏輯元件/單元數(shù)： | 60440 |
| RAM 位總計： | 2544192 |
| 輸入/輸出數(shù)： | 492 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 672-BBGA |
| 供應(yīng)商設(shè)備封裝： | 672-BGA（27x27） |
| 配用： | 544-1700-ND - DSP KIT W/STRATIX II EP2S60N 544-1697-ND - NIOS II KIT W/STRATIX II EP2S60N |
| 其它名稱： | 544-1914 EP2S60F672C5N-ND |
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5–4
Altera Corporation
Stratix II Device Handbook, Volume 1
April 2011
Operating Conditions
I/O Standard Specifications
Tables 5–5 through 5–32 show the Stratix II device family I/O standard
specifications.
ICCI00
VCCIO supply current
(standby)
VI = ground, no
load, no toggling
inputs
TJ = 25° C
EP2S15
4.0
mA
EP2S30
4.0
mA
EP2S60
4.0
mA
EP2S90
4.0
mA
EP2S130
4.0
mA
EP2S180
4.0
mA
RCONF (4) Value of I/O pin pull-up
resistor before and
during configuration
Vi = 0; VCCIO = 3.3 V
10
25
50
k
Ω
Vi = 0; VCCIO = 2.5 V
15
35
70
k
Ω
Vi = 0; VCCIO = 1.8 V
30
50
100
k
Ω
Vi = 0; VCCIO = 1.5 V
40
75
150
k
Ω
Vi = 0; VCCIO = 1.2 V
50
90
170
k
Ω
Recommended value of
I/O pin external
pull-down resistor before
and during configuration
12
k
Ω
Notes to Table 5–4:
(1)
Typical values are for TA = 25°C, VCCINT = 1.2 V, and VCCIO = 1.5 V, 1.8 V, 2.5 V, and 3.3 V.
(2)
This value is specified for normal device operation. The value may vary during power-up. This applies for all
VCCIO settings (3.3, 2.5, 1.8, and 1.5 V).
(3)
Maximum values depend on the actual TJ and design utilization. See the Excel-based PowerPlay Early Power
Estimator (available at www.altera.com) or the Quartus II PowerPlay Power Analyzer feature for maximum
values. See the section “Power Consumption” on page 5–20 for more information.
(4)
Pin pull-up resistance values are lower if an external source drives the pin higher than VCCIO.
Table 5–4. Stratix II Device DC Operating Conditions (Part 2 of 2)
Note (1)
Symbol
Parameter
Conditions
Minimum Typical Maximum Unit
Table 5–5. LVTTL Specifications (Part 1 of 2)
Symbol
Parameter
Conditions
Minimum
Maximum
Unit
VCCIO (1)
Output supply voltage
3.135
3.465
V
VIH
High-level input voltage
1.7
4.0
V
VIL
Low-level input voltage
–0.3
0.8
V
VOH
High-level output voltage
2.4
V
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