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2–52
Altera Corporation
Stratix II Device Handbook, Volume 1
May 2007
PLLs & Clock Networks
IOE clocks have row and column block regions that are clocked by eight
I/O clock signals chosen from the 24 quadrant clock resources.
Figures 2–35 and 2–36 show the quadrant relationship to the I/O clock
regions.
Figure 2–35. EP2S15 & EP2S30 Device I/O Clock Groups
IO_CLKC[7:0]
IO_CLKF[7:0]
IO_CLKE[7:0]
IO_CLKA[7:0]
IO_CLKB[7:0]
IO_CLKD[7:0]
IO_CLKH[7:0]
IO_CLKG[7:0]
8
24 Clocks in
the Quadrant
24 Clocks in
the Quadrant
24 Clocks in
the Quadrant
24 Clocks in
the Quadrant
8
I/O Clock Regions
相關PDF資料 |
PDF描述 |
|---|---|
| FMC10DREH-S13 | CONN EDGECARD 20POS .100 EXTEND |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| EP2S30F484C5N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 1694 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S30F484I4 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 1694 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S30F484I4AA | 制造商:Altera Corporation 功能描述:FPGA Stratix 制造商:Altera Corporation 功能描述:FPGA Stratix? II Family 33880 Cells 711.24MHz 90nm Technology 1.2V 484-Pin FBGA |
| EP2S30F484I4AB | 制造商:Altera Corporation 功能描述:FPGA Stratix |
| EP2S30F484I4N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 1694 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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