參數(shù)資料
型號(hào)： EP20K60ERC208-3ES
元件分類： 電源監(jiān)測(cè)
英文描述： Dual Voltage Monitor with Intergrated CPU Supervisor
中文描述： 雙電壓監(jiān)視器集成CPU監(jiān)控
文件頁數(shù)： 103/114頁
文件大?。?/td> 1623K
代理商： EP20K60ERC208-3ES
Altera Corporation
89
APEX 20K Programmable Logic Device Family Data Sheet
Table 61. EP20K60E Fmax Routing Delays
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tF1-4
0.24
0.26
0.30
ns
tF5-20
1.45
1.58
1.79
ns
tF20+
1.96
2.14
2.45
ns
Table 62. EP20K60E Minimum Pulse Width Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tCH
2.00
2.50
2.75
ns
tCL
2.00
2.50
2.75
ns
tCLRP
0.20
0.28
0.41
ns
tPREP
0.20
0.28
0.41
ns
tESBCH
2.00
2.50
2.75
ns
tESBCL
2.00
2.50
2.75
ns
tESBWP
1.29
1.80
2.66
ns
tESBRP
1.04
1.45
2.14
ns
Table 63. EP20K60E External Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSU
2.03
2.12
2.23
ns
tINH
0.00
ns
tOUTCO
2.00
4.84
2.00
5.31
2.00
5.81
ns
tINSUPLL
1.12
1.15
-
ns
tINHPLL
0.00
-
ns
tOUTCOPLL
0.50
3.37
0.50
3.69
-
ns
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PDF描述
EP20K60ERC240-1ES FPGA
EP20K60ERC240-2ES FPGA
EP20K60ERC240-3ES FPGA
EP20K60ERI208-1ES FPGA
EP20K60ERI208-2ES FPGA
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參數(shù)描述
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