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參數(shù)資料
| 型號： | EP20K60EQI240-1ES |
| 元件分類： | 電源監(jiān)測 |
| 英文描述： | Dual Voltage Monitor with Intergrated CPU Supervisor |
| 中文描述： | 雙電壓監(jiān)視器集成CPU監(jiān)控 |
| 文件頁數(shù)： | 4/114頁 |
| 文件大?。?/td> | 1623K |
| 代理商： | EP20K60EQI240-1ES |
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Altera Corporation
101
APEX 20K Programmable Logic Device Family Data Sheet
ESB Timing Microparameters, fMAX Routing Delays, Minimum Pulse
Width Timing Parameters, External Timing Parameters, and External
Bidirectional Timing Parameters for EP20K400E APEX 20KE devices.
Table 89. EP20K400E fMAX LE Timing Microparameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tSU
0.23
ns
tH
0.23
ns
tCO
0.25
0.29
0.32
ns
tLUT
0.70
0.83
1.01
ns
Table 90. EP20K400E fMAX ESBTiming Microparameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tESBARC
1.67
1.91
1.99
ns
tESBSRC
2.30
2.66
2.93
ns
tESBAWC
3.09
3.58
3.99
ns
tESBSWC
3.01
3.65
4.05
ns
tESBWASU
0.54
0.63
0.65
ns
tESBWAH
0.36
0.43
0.42
ns
tESBWDSU
0.69
0.77
0.84
ns
tESBWDH
0.36
0.43
0.42
ns
tESBRASU
1.61
1.77
1.86
ns
tESBRAH
0.00
0.01
ns
tESBWESU
1.35
1.47
1.61
ns
tESBDATASU
-0.18
-0.30
-0.27
ns
tESBWADDRSU
-0.02
-0.11
-0.03
ns
tESBRADDRSU
0.06
-0.01
-0.05
ns
tESBDATACO1
1.16
1.40
1.54
ns
tESBDATACO2
2.18
2.55
2.85
ns
tESBDD
2.73
3.17
3.58
ns
tPD
1.57
1.83
2.07
ns
tPTERMSU
0.92
0.99
1.18
ns
tPTERMCO
1.18
1.43
1.17
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP20K60EQI240-2ES | FPGA |
| EP20K60EQI240-3ES | FPGA |
| EP20K60ERC208-1ES | Dual Voltage Monitor with Intergrated CPU Supervisor |
| EP20K60ERC208-2ES | Dual Voltage Monitor with Intergrated CPU Supervisor |
| EP20K60ERC208-3ES | Dual Voltage Monitor with Intergrated CPU Supervisor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EP20K60EQI240-2ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K60EQI240-3ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K60ERC208-1ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K60ERC208-2ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K60ERC208-3ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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