參數(shù)資料
型號： EP20K60EFI324-3ES
元件分類： 電源監(jiān)測
英文描述： Dual Voltage Monitor with Intergrated CPU Supervisor
中文描述： 雙電壓監(jiān)視器集成CPU監(jiān)控
文件頁數(shù)： 101/114頁
文件大?。?/td> 1623K
代理商： EP20K60EFI324-3ES
Altera Corporation
87
APEX 20K Programmable Logic Device Family Data Sheet
Table 56. EP20K30E Minimum Pulse Width Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tCH
0.55
0.78
1.15
ns
tCL
0.55
0.78
1.15
ns
tCLRP
0.22
0.31
0.46
ns
tPREP
0.22
0.31
0.46
ns
tESBCH
0.55
0.78
1.15
ns
tESBCL
0.55
0.78
1.15
ns
tESBWP
1.43
2.01
2.97
ns
tESBRP
1.15
1.62
2.39
ns
Table 57. EP20K30E External Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSU
2.02
2.13
2.24
ns
tINH
0.00
ns
tOUTCO
2.00
4.88
2.00
5.36
2.00
5.88
ns
tINSUPLL
2.11
2.23
-
ns
tINHPLL
0.00
-
ns
tOUTCOPLL
0.50
2.60
0.50
2.88
-
ns
Table 58. EP20K30E External Bidirectional Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSUBIDIR
1.85
1.77
1.54
ns
tINHBIDIR
0.00
ns
tOUTCOBIDIR
2.00
4.88
2.00
5.36
2.00
5.88
ns
tXZBIDIR
7.48
8.46
9.83
ns
tZXBIDIR
7.48
8.46
9.83
ns
tINSUBIDIRPLL
4.12
4.24
-
ns
tINHBIDIRPLL
0.00
-
ns
tOUTCOBIDIRPLL
0.50
2.60
0.50
2.88
-
ns
tXZBIDIRPLL
5.21
5.99
-
ns
tZXBIDIRPLL
5.21
5.99
-
ns
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PDF描述
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