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參數(shù)資料
| 型號(hào)： | EP20K60E |
| 廠商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family |
| 中文描述： | 可編程邏輯器件系列 |
| 文件頁數(shù)： | 75/117頁 |
| 文件大小： | 570K |
| 代理商： | EP20K60E |
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Altera Corporation
75
APEX 20K Programmable Logic Device Family Data Sheet
Note to
Table 36
:
(1)
These parameters are worst-case values for typical applications. Post-compilation
timing simulation and timing analysis are required to determine actual worst-case
performance.
Tables 38
and
39
describe the APEX 20KE external timing parameters.
Table 36. APEX 20KE Routing Timing Microparameters
Note (1)
Symbol
Parameter
t
F1-4
t
F5-20
t
F20+
Fanout delay using Local Interconnect
Fanout delay estimate using MegaLab Interconnect
Fanout delay estimate using FastTrack Interconnect
Table 37. APEX 20KE Functional Timing Microparameters
Symbol
Parameter
TCH
TCL
TCLRP
TPREP
TESBCH
TESBCL
TESBWP
TESBRP
Minimum clock high time from clock pin
Minimum clock low time from clock pin
LE clear Pulse Width
LE preset pulse width
Clock high time for ESB
Clock low time for ESB
Write pulse width
Read pulse width
Table 38. APEX 20KE External Timing Parameters
Note (1)
Symbol
Clock Parameter
Conditions
t
INSU
t
INH
t
OUTCO
t
INSUPLL
t
INHPLL
t
OUTCOPLL
Setup time with global clock at IOE input register
Hold time with global clock at IOE input register
Clock-to-output delay with global clock at IOE output register
Setup time with PLL clock at IOE input register
Hold time with PLL clock at IOE input register
Clock-to-output delay with PLL clock at IOE output register
C1 = 10 pF
C1 = 10 pF
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP220 | Classic EPLDs |
| EP220-10 | Classic EPLDs |
| EP220-10A | Classic EPLDs |
| EP220-12 | Classic EPLDs |
| EP220-7 | Classic EPLDs |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EP20K60EBC356-1 | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 CPLD - APEX 20K 256 Macro 196 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP20K60EBC356-1ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K60EBC356-1X | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 CPLD - APEX 20K 256 Macro 196 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP20K60EBC356-2 | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 CPLD - APEX 20K 256 Macro 196 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP20K60EBC356-2ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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