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Altera Corporation
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APEX 20K Programmable Logic Device Family Data Sheet
for APEX 20KE devices.
Table 17. APEX 20KE ClockLock & ClockBoost Parameters
Symbol
Parameter
Condition
Min
Typ
Max
Unit
tR
Input rise time
5ns
tF
Input fall time
5ns
tINDUTY
Input duty cycle
40
60
%
tINJITTER
Input jitter peak-to-peak
2
% of input
period
peak-to-
peak
tOUTJITTER Jitter on ClockLock or ClockBoost-
generated clock
0.35
% of
output period
RMS
tOUTDUTY
Duty cycle for ClockLock or
ClockBoost-generated clock
45
55
%
tLOCK (2),
Time required for ClockLock or
ClockBoost to acquire lock
40
s
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP20K600EFI1020-2X | FPGA |
| EP20K600EFI1020-3 | FPGA |
| EP20K600EFI1020-3ES | FPGA |
| EP20K600EFI672-1ES | FPGA |
| EP20K600EFI672-2ES | FPGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EP20K600EFI1020-2X | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K600EFI1020-3 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K600EFI1020-3ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K600EFI672-1ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K600EFI672-2ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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