參數資料
型號： EP20K100TI144-2
英文描述： Field Programmable Gate Array (FPGA)
中文描述： 現場可編程門陣列（FPGA）
文件頁數： 8/114頁
文件大?。?/td> 1623K
代理商： EP20K100TI144-2
Altera Corporation
105
APEX 20K Programmable Logic Device Family Data Sheet
Table 98. EP20K600E Minimum Pulse Width Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tCH
2.00
2.50
2.75
ns
tCL
2.00
2.50
2.75
ns
tCLRP
0.18
0.26
0.34
ns
tPREP
0.18
0.26
0.34
ns
tESBCH
2.00
2.50
2.75
ns
tESBCL
2.00
2.50
2.75
ns
tESBWP
1.17
1.68
2.18
ns
tESBRP
0.95
1.35
1.76
ns
Table 99. EP20K600E External Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tINSU
2.74
2.87
ns
tINH
0.00
ns
tOUTCO
2.00
5.51
2.00
6.06
2.00
6.61
ns
tINSUPLL
1.86
1.96
-
ns
tINHPLL
0.00
-
ns
tOUTCOPLL
0.50
2.62
0.50
2.91
-
ns
Table 100. EP20K600E External Bidirectional Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tINSUBIDIR
0.64
0.98
1.08
ns
tINHBIDIR
0.00
ns
tOUTCOBIDIR
2.00
5.51
2.00
6.06
2.00
6.61
ns
tXZBIDIR
6.10
6.74
7.10
ns
tZXBIDIR
6.10
6.74
7.10
ns
tINSUBIDIRPLL
2.26
2.68
-
ns
tINHBIDIRPLL
0.00
-
ns
tOUTCOBIDIRPLL
0.50
2.62
0.50
2.91
-
ns
tXZBIDIRPLL
3.21
3.59
-
ns
tZXBIDIRPLL
3.21
3.59
-
ns
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