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參數(shù)資料
| 型號： | EP20K100EQC240-2 |
| 廠商： | Altera |
| 文件頁數(shù)： | 115/117頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC APEX 20KE FPGA 100K 240-PQFP |
| 產(chǎn)品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 24 |
| 系列： | APEX-20K® |
| LAB/CLB數(shù)： | 416 |
| 邏輯元件/單元數(shù)： | 4160 |
| RAM 位總計： | 53248 |
| 輸入/輸出數(shù)： | 183 |
| 門數(shù)： | 263000 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 240-BFQFP |
| 供應商設備封裝： | 240-PQFP（32x32） |
| 其它名稱： | 544-1864 EP20K100EQC240-2-ND |
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Altera Corporation
97
APEX 20K Programmable Logic Device Family Data Sheet
ESB Timing Microparameters, fMAX Routing Delays, Minimum Pulse
Width Timing Parameters, External Timing Parameters, and External
Bidirectional Timing Parameters for EP20K300E APEX 20KE devices.
Table 78. EP20K200E External Bidirectional Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSU BIDIR
2.81
3.19
3.54
ns
tI N H B ID IR
0.00
ns
tOUT C OBIDIR
2.00
5.12
2.00
5.62
2.00
6.11
ns
tXZ BIDIR
7.51
8.32
8.67
ns
tZX BIDIR
7.51
8.32
8.67
ns
tINSU BIDIRPL L
3.30
3.64
-
ns
tI N H B ID IR P L L
0.00
-
ns
tOUT C OBIDIRP LL
0.50
3.01
0.50
3.36
-
ns
tXZ BIDIRPL L
5.40
6.05
-
ns
tZX BIDIRPL L
5.40
6.05
-
ns
Table 79. EP20K300E fMAX LE Timing Microparameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tSU
0.16
0.17
0.18
ns
tH
0.31
0.33
0.38
ns
tCO
0.28
0.38
0.51
ns
tLUT
0.79
1.07
1.43
ns
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PDF描述 |
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| EP20K100EQC240-3ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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