參數(shù)資料
型號(hào)： EP1SGX25DF1020C6N
廠商： Altera
文件頁(yè)數(shù)： 716/1456頁(yè)
文件大?。?/td> 0K
描述： IC STRATIX GX FPGA 25K 1020-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 12
系列： Stratix® GX
LAB/CLB數(shù)： 2566
邏輯元件/單元數(shù)： 25660
RAM 位總計(jì)： 1944576
輸入/輸出數(shù)： 607
電源電壓： 1.425 V ~ 1.575 V
安裝類(lèi)型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1020-BBGA
供應(yīng)商設(shè)備封裝： 1020-FBGA（33x33）
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Altera Corporation
2–29
June 2006
Stratix GX Device Handbook, Volume 1
Stratix GX Transceivers
Figure 2–24. BIST PRBS Data Path
Figure 2–25. BIST Incremental Data Path
Table 2–9 shows the BIST data output and verifier alignment pattern.
Clock
Recovery
Unit
Deserializer
Word
Aligner
BIST PRBS
Verifier
BIST
Incremental
Verifier
BIST
Generator
Byte
Deserializer
Phase
Compensation
FIFO
Phase
Compensation
FIFO
Byte
Serializer
Channel
Aligner
Rate
Matcher
8B/10B
Decoder
Serializer
BIST PRBS
Generator
8B/10B
Encoder
Non-active Path
Active Path
Deserializer
Word
Aligner
BIST PRBS
Verifier
Channel
Aligner
Rate
Matcher
8B/10B
Decoder
BIST
Generator
Byte
Deserializer
Phase
Compensation
FIFO
Serializer
BIST PRBS
Generator
8B/10B
Encoder
Non-active Path
Active Path
Clock
Recovery
Unit
BIST
Incremental
Verifier
Phase
Compensation
FIFO
Byte
Serializer
Table 2–9. BIST Data Output & Verifier Alignment Pattern (Part 1 of 2)
BIST Mode
Output
Polynomials
Verifier Word Alignment Pattern
PRBS 8-bit
28 – 1
x8 + x7 + x5 + x3 + 1
1000000011111111
PRBS 10-bit
210 – 1
x10 + x7 + 1
1111111111
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