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參數(shù)資料
| 型號(hào)： | EP1SGX10DF672C6N |
| 廠商： | Altera |
| 文件頁數(shù)： | 1041/1456頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX GX FPGA 10KLE 672FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 20 |
| 系列： | Stratix® GX |
| LAB/CLB數(shù)： | 1057 |
| 邏輯元件/單元數(shù)： | 10570 |
| RAM 位總計(jì)： | 920448 |
| 輸入/輸出數(shù)： | 362 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 672-BBGA |
| 供應(yīng)商設(shè)備封裝： | 672-BGA（27x27） |
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2–30
Altera Corporation
Stratix GX Device Handbook, Volume 2
June 2006
MegaWizard Plug-In Manager Analog Features
Figure 2–20 shows page 10 of the MegaWizard Plug-In Manager for the
analog feature. You can select optional files on this page. After you make
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Figure 2–20. MegaWizard Plug-In Manager - altgxb (Page 10)
Stratix GX Transceiver Merging
A transceiver block contains four transceivers. In a design, an altgxb
instantiation is placed in one or more transceiver blocks and potentially
leaves unused transceivers in a block. For example, a six transceiver
instantiation completely fills one transceiver block and half fills a second,
taking up two full transceiver blocks. If another instantiation is in the
design, it is placed the same way. For example, an instantiation of two
transmitters takes up a third transceiver block. Merging two of the
partially filled transceiver blocks into one transceiver block reduces the
resources used and allows a design to fit into a device with fewer
transceiver blocks.
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