參數(shù)資料
型號: EP1S60F1508C7N
廠商: Altera
文件頁數(shù): 562/864頁
文件大?。?/td> 0K
描述: IC STRATIX FPGA 60K LE 1508-FBGA
產(chǎn)品培訓模塊: Three Reasons to Use FPGA's in Industrial Designs
產(chǎn)品變化通告: Package Height Change 03/March/2008
標準包裝: 7
系列: Stratix®
LAB/CLB數(shù): 5712
邏輯元件/單元數(shù): 57120
RAM 位總計: 5215104
輸入/輸出數(shù): 1022
電源電壓: 1.425 V ~ 1.575 V
安裝類型: 表面貼裝
工作溫度: 0°C ~ 85°C
封裝/外殼: 1508-BBGA
供應(yīng)商設(shè)備封裝: 1508-FBGA(30x30)
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7–26
Altera Corporation
Stratix Device Handbook, Volume 2
September 2004
Finite Impulse Response (FIR) Filters
Figure 7–15. Time & Frequency Domain Representations of Decimation for D=4
Polyphase Decimation Filters
Figure 7–14 shows a direct implementation of a decimation filter, which
imposes a high computational burden. For example, if the filter is 16 taps
long and a multiplication takes one cycle, the number of computations
required per cycle is 16
× D. Depending on the decimation factor (D), this
number can be quite big and may not be achievable in hardware. A
polyphase implementation of the low pass filter can reduce the number
of computations required, often by a large ratio, as will be evident later in
this section.
The polyphase implementation “splits” the original filter into D
polyphase filters with impulse responses defined by the following
equation.
hk n
()
hk nD
+
()
=
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PDF描述
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