參數(shù)資料
型號： EP1S30F780C5N
廠商： Altera
文件頁數(shù)： 784/864頁
文件大?。?/td> 0K
描述： IC STRATIX FPGA 30K LE 780-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
產(chǎn)品變化通告： Package Height Change 03/March/2008
標(biāo)準(zhǔn)包裝： 18
系列： Stratix®
LAB/CLB數(shù)： 3247
邏輯元件/單元數(shù)： 32470
RAM 位總計： 3317184
輸入/輸出數(shù)： 597
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 780-BBGA
供應(yīng)商設(shè)備封裝： 780-FBGA（29x29）
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12–26
Altera Corporation
Stratix Device Handbook, Volume 2
September 2004
Using Enhanced Configuration Devices
3.
Select the enhanced configuration device (EPC4, EPC8, EPC16), and
the mode used (1-bit Passive Serial or Fast Passive Parallel). Only
during the initial programming file generation can you specify the
Options
, Configuration device, or Mode settings. While generating
the partial programming file, all of these settings are grayed out and
inaccessible.
4.
In the Input files to convert box, highlight SOF Data at Page 0 and
click Add File. Select input SOF file(s) for this configuration page
and insert them.
5.
Repeat Step 4 for the Page 1 application configuration page.
6.
For enabling block addressing, select the SOF Data entry for Page 1,
and click Properties. This opens the SOF Data Properties dialog
box (see Figure 12–15).
7.
Pick Block from the Address Mode drop down selection, and enter
32-bit Hexadecimal byte address for block Starting Address and
Ending Address
. Note that for partial programming support, the
block start and end addresses should be aligned to a flash sector
boundary. This prevents two configuration pages from overlapping
within the same flash boundary. See the flash memory datasheet for
data sector boundary information. Click OK to save SOF data
properties.
8.
Check the Memory Map File box to generate a memory map output
file that specifies the start/end addresses of each configuration page
and user data blocks.
9.
Save the CPF setup (optionally), by selecting Save Conversion
Setup
… and specifying a name for the COF output file.
10. Click OK to generate initial programming and memory map files.
相關(guān)PDF資料
PDF描述
24AA02T-I/MS IC EEPROM 2KBIT 400KHZ 8MSOP
EP2SGX60EF1152I4N IC STRATIX II GX 60K 1152-FBGA
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AGM36DTBS CONN EDGECARD 72POS R/A .156 SLD
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EP1S30F780C6N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S30F780C7 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S30F780C7N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S30F780C8 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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