參數(shù)資料
型號： EP1S25B672C7
廠商： Altera
文件頁數(shù)： 469/864頁
文件大小： 0K
描述： IC STRATIX FPGA 25K LE 672-BGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 8
系列： Stratix®
LAB/CLB數(shù)： 2566
邏輯元件/單元數(shù)： 25660
RAM 位總計(jì)： 1944576
輸入/輸出數(shù)： 473
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 672-BBGA
供應(yīng)商設(shè)備封裝： 672-BGA（35x35）
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5–48
Altera Corporation
Stratix Device Handbook, Volume 2
July 2005
Differential I/O Termination
Figure 5–35. PCML Differential Termination
Differential HSTL Termination
The HSTL Class I and II I/O standards require a 0.75-V VREF and a 0.75-
V VTT. Figures 5–36 and 5–37 show the device with differential
termination for HSTL Class I and II I/O standard.
Figure 5–36. Differential HSTL Class I Termination
Differential
Transmitter
Differential
Receiver
Z0 = 50 Ω
50
Ω
50
Ω
50
Ω
50
Ω
Z0 = 50 Ω
VTT
Differential
Transmitter
Differential
Receiver
Z0 = 50 Ω
50
Ω
50
Ω
Z0 = 50 Ω
VTT = 0.75 V
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PDF描述
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