參數(shù)資料
型號： EP1K30
廠商： Altera Corporation
英文描述： ACEX 1K Programmable Logic Family(ACEX 1K 系列可編程邏輯)
中文描述： ACEX一千可編程邏輯系列（ACEX每1000系列可編程邏輯）
文件頁數(shù)： 73/84頁
文件大小： 1366K
代理商： EP1K30
Altera Corporation
73
Preliminary Information
ACEX 1K Programmable Logic Family Data Sheet
D
13
T
Note to tables:
(1)
All timing parameters are described in
Tables 22
through
29
in this data sheet.
(2)
These parameters are specified by characterization.
(3)
This parameter is measured without the use of the ClockLock or ClockBoost circuits.
(4)
This parameter is measured with the use of the ClockLock or ClockBoost circuits.
Tables 51
through
57
show the EP1K100 device internal and external
timing parameters.
Table 50. EP1K50 External Bidirectional Timing Parameters
Notes (1)
,
(2)
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
t
INSUBDIR
t
INHBIDIR
t
OUTCOBIDIR
(3)
t
XZBIDIR
(3)
t
ZXBIDIR
(3)
t
OUTCOBIDIR
(4)
t
XZBIDIR
(4)
t
ZXBIDIR
(4)
1.5
0.0
2.0
2.0
2.0
0.5
0.5
0.5
2.2
0.0
2.0
2.0
2.0
0.5
0.5
0.5
3.6
0.0
2.0
2.0
2.0
–
–
–
ns
ns
ns
ns
ns
ns
ns
ns
3.5
5.8
4.7
2.5
4.8
3.7
4.5
6.3
5.3
3.5
5.3
4.3
7.1
8.0
7.2
–
–
–
Table 51. EP1K100 Device LE Timing Microparameters (Part 1 of 2)
Note (1)
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
t
LUT
t
CLUT
t
RLUT
t
PACKED
t
EN
t
CICO
t
CGEN
t
CGENR
t
CASC
t
C
t
CO
t
COMB
t
SU
0.6
0.5
0.7
0.5
0.6
0.2
0.5
0.2
0.8
0.5
0.5
0.5
0.8
0.6
0.8
0.6
0.7
0.2
0.5
0.2
0.9
0.6
0.6
0.6
1.1
0.8
1.1
0.8
0.9
0.3
0.8
0.3
1.2
0.8
0.7
0.7
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
0.5
0.6
0.8
相關PDF資料
PDF描述
EP1K50 ACEX 1K Programmable Logic Family(ACEX 1K 系列可編程邏輯)
EP1K30TI144-2 Dual LDO with Low Noise, Low IQ, and High PSRR; Temperature Range: -40°C to 85°C; Package: 10-DFN
EP1K10 Programmable Logic Device Family
EP1K100 Programmable Logic Device Family
EP1K30 Programmable Logic Device Family
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