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參數(shù)資料
| 型號： | EP1C6T100I6ES |
| 廠商： | Altera Corporation |
| 英文描述： | Cyclone FPGA Family Data Sheet |
| 中文描述： | 氣旋的FPGA系列數(shù)據(jù)手冊 |
| 文件頁數(shù)： | 74/104頁 |
| 文件大?。?/td> | 763K |
| 代理商： | EP1C6T100I6ES |
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4–4
Preliminary
Altera Corporation
January 2007
Cyclone Device Handbook, Volume 1
Table 4–7. 1.8-V I/O Specifications
Symbol
Parameter
Conditions
Minimum
Maximum
Unit
V
CCIO
Output supply voltage
1.65
1.95
V
V
IH
High-level input voltage
0.65
×
V
CCIO
2.25
(12)
V
V
IL
Low-level input voltage
–0.3
0.35
×
V
CCIO
V
V
OH
High-level output voltage
I
OH
= –2 to –8 mA
(11)
V
CCIO
– 0.45
V
V
OL
Low-level output voltage
I
OL
= 2 to 8 mA
(11)
0.45
V
Table 4–8. 1.5-V I/O Specifications
Symbol
Parameter
Conditions
Minimum
Maximum
Unit
V
CCIO
Output supply voltage
1.4
1.6
V
V
IH
High-level input voltage
0.65
×
V
CCIO
V
CCIO
+ 0.3
(12)
0.35
×
V
CCIO
V
V
IL
Low-level input voltage
–0.3
V
V
OH
High-level output voltage
I
OH
= –2 mA
(11)
0.75
×
V
CCIO
V
V
OL
Low-level output voltage
I
OL
= 2 mA
(11)
0.25
×
V
CCIO
V
Table 4–9. 2.5-V LVDS I/O Specifications
Note (13)
Symbol
Parameter
Conditions
Minimum
Typical
Maximum
Unit
V
CCIO
I/O supply voltage
2.375
2.5
2.625
V
V
OD
Δ
V
OD
Differential output voltage
R
L
= 100
Ω
R
L
= 100
Ω
250
550
mV
Change in V
OD
between
high and low
50
mV
V
OS
Δ
V
OS
Output offset voltage
R
L
= 100
Ω
R
L
= 100
Ω
1.125
1.25
1.375
V
Change in V
OS
between
high and low
50
mV
V
TH
Differential input threshold
V
CM
= 1.2 V
–100
100
mV
V
I
N
Receiver input voltage
range
0.0
2.4
V
R
L
Receiver differential input
resistor
90
100
110
Ω
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP1C6T100I7ES | Cyclone FPGA Family Data Sheet |
| EP1C6T100I8ES | Cyclone FPGA Family Data Sheet |
| EP1C6T144C6ES | Cyclone FPGA Family Data Sheet |
| EP1C6T144C7ES | Cyclone FPGA Family Data Sheet |
| EP1C6T144C8ES | Cyclone FPGA Family Data Sheet |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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