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參數(shù)資料
| 型號： | EP1C6Q324I8ES |
| 廠商： | Altera Corporation |
| 英文描述： | Cyclone FPGA Family Data Sheet |
| 中文描述： | 氣旋的FPGA系列數(shù)據(jù)手冊 |
| 文件頁數(shù)： | 90/104頁 |
| 文件大?。?/td> | 763K |
| 代理商： | EP1C6Q324I8ES |
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4–20
Preliminary
Altera Corporation
January 2007
Cyclone Device Handbook, Volume 1
Tables 4–38
through
4–39
show the external timing parameters on column
and row pins for EP1C20 devices.
t
I
N
HPLL
0.000
0.000
0.000
ns
t
OUTCOPLL
0.500
1.663
0.500
1.913
0.500
2.164
ns
Table 4–37. EP1C12 Row Pin Global Clock External I/O Timing Parameters
Symbol
-6 Speed Grade
-7 Speed Grade
-8 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
t
I
N
SU
2.620
3.012
3.404
ns
t
I
N
H
0.000
0.000
0.000
ns
t
OUTCO
2.000
3.671
2.000
4.221
2.000
4.774
ns
t
I
N
SUPLL
1.698
1.951
2.206
ns
t
I
N
HPLL
0.000
0.000
0.000
ns
t
OUTCOPLL
0.500
1.536
0.500
1.767
0.500
1.998
ns
Table 4–38. EP1C20 Column Pin Global Clock External I/O Timing
Parameters
Symbol
-6 Speed Grade
-7 Speed Grade
-8 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
t
I
N
SU
2.417
2.779
3.140
ns
t
I
N
H
0.000
0.000
0.000
ns
t
OUTCO
2.000
3.724
2.000
4.282
2.000
4.843
ns
t
I
N
SUPLL
1.417
1.629
1.840
ns
t
I
N
HPLL
0.000
0.000
0.000
ns
t
OUTCOPLL
0.500
1.667
0.500
1.917
0.500
2.169
ns
Table 4–36. EP1C12 Column Pin Global Clock External I/O Timing
Parameters (Part 2 of 2)
Symbol
-6 Speed Grade
-7 Speed Grade
-8 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
相關(guān)PDF資料 |
PDF描述 |
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