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參數(shù)資料
| 型號： | EP1C6Q256C6ES |
| 廠商： | Altera Corporation |
| 英文描述： | Cyclone FPGA Family Data Sheet |
| 中文描述： | 氣旋的FPGA系列數(shù)據(jù)手冊 |
| 文件頁數(shù)： | 86/104頁 |
| 文件大?。?/td> | 763K |
| 代理商： | EP1C6Q256C6ES |
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4–16
Preliminary
Altera Corporation
January 2007
Cyclone Device Handbook, Volume 1
Figure 4–2. External Timing in Cyclone Devices
All external I/O timing parameters shown are for 3.3-V LVTTL I/O
standard with the maximum current strength and fast slew rate. For
external I/O timing using standards other than LVTTL or for different
current strengths, use the I/O standard input and output delay adders in
Tables 4–40
through
4–44
.
Table 4–29
shows the external I/O timing parameters when using global
clock networks.
PRN
CLRN
D
Q
PRN
CLRN
D
Q
PRN
CLRN
D
Q
Dedicated
Clock
Bidirectional
Pin
Output Register
Input Register
OE Register
t
XZ
t
ZX
t
INSU
t
INH
t
OUTCO
Table 4–29. Cyclone Global Clock External I/O Timing Parameters
Notes (1)
,
(2)
(Part 1 of 2)
Symbol
Parameter
Conditions
t
I
N
SU
Setup time for input or bidirectional pin using IOE input
register with global clock fed by
CLK
pin
t
I
N
H
Hold time for input or bidirectional pin using IOE input
register with global clock fed by
CLK
pin
t
OUTCO
Clock-to-output delay output or bidirectional pin using IOE
output register with global clock fed by
CLK
pin
C
LOAD
= 10 pF
t
I
N
SUPLL
Setup time for input or bidirectional pin using IOE input
register with global clock fed by Enhanced PLL with default
phase setting
t
I
N
HPLL
Hold time for input or bidirectional pin using IOE input
register with global clock fed by enhanced PLL with default
phase setting
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP1C6Q256C7ES | Cyclone FPGA Family Data Sheet |
| EP1C6Q256C8ES | Cyclone FPGA Family Data Sheet |
| EP1C6Q256I6ES | Cyclone FPGA Family Data Sheet |
| EP1C6Q256I7ES | Cyclone FPGA Family Data Sheet |
| EP1C6Q256I8ES | Cyclone FPGA Family Data Sheet |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| EP1C6T144C7N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Cyclone I 598 LABs 98 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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