參數(shù)資料
型號： EP1C6F400C6
廠商： Altera Corporation
英文描述： Cyclone FPGA Family
中文描述： 氣旋FPGA系列
文件頁數(shù)： 91/94頁
文件大?。?/td> 1138K
代理商： EP1C6F400C6
Altera Corporation
91
Preliminary Information
Cyclone FPGA Family Data Sheet
Maximum Input & Output Clock Rates
Tables 67
and
68
show the maximum input clock rate for column and row
pins in Cyclone devices.
Table 66. Cyclone IOE Programmable Delays on Row Pins
Parameter
Setting
-6 Speed Grade
-7 Speed Grade
-8 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
Decrease input delay to
internal cells
On
Small
Medium
Large
On
3,057
2,212
2,639
3,057
3,057
3,362
2,433
2,902
3,362
3,362
3,668
2,654
3,166
3,668
3,668
ps
ps
ps
ps
ps
Decrease input delay to
input register
Increase delay to output
pin
On
556
611
667
ps
Table 67. Cyclone Maximum Input Clock Rate for Column Pins
I/O Standard
-6 Speed
Grade
-7 Speed
Grade
-8 Speed
Grade
Unit
LVTTL
2.5 V
1.8 V
1.5 V
LVCMOS
SSTL-3 class I
SSTL-3 class II
SSTL-2 class I
SSTL-2 class II
LVDS
304
220
213
166
304
100
100
134
134
231
304
220
213
166
304
100
100
134
134
231
304
220
213
166
304
100
100
134
134
231
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
MHz
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PDF描述
EP1C6F400C7 Cyclone FPGA Family
EP1C6F400C8 Cyclone FPGA Family
EP1C6F400I6 Cyclone FPGA Family
EP1C6T324I7 Cyclone FPGA Family
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