參數(shù)資料
型號(hào)： EP1C6F324C6ES
廠商： Altera Corporation
英文描述： Cyclone FPGA Family Data Sheet
中文描述： 氣旋的FPGA系列數(shù)據(jù)手冊(cè)
文件頁(yè)數(shù)： 53/104頁(yè)
文件大?。?/td> 763K
代理商： EP1C6F324C6ES
Altera Corporation
January 2007
2–47
Preliminary
I/O Structure
output pins (
nSTATUS
and
CONF_DONE
) and all the JTAG pins in I/O
bank 3 must operate at 2.5 V because the V
CCIO
level of SSTL-2 is 2.5 V.
I/O banks 1, 2, 3, and 4 support DQS signals with DQ bus modes of
×
8.
For
×
8 mode, there are up to eight groups of programmable DQS and DQ
pins, I/O banks 1, 2, 3, and 4 each have two groups in the 324-pin and
400-pin FineLine BGA packages. Each group consists of one DQS pin, a
set of eight DQ pins, and one DM pin (see
Figure 2–33
). Each DQS pin
drives the set of eight DQ pins within that group.
Figure 2–33. Cyclone Device DQ & DQS Groups in
×
8 Mode
Note (1)
Note to
Figure 2–33
:
(1)
Each DQ group consists of one DQS pin, eight DQ pins, and one DM pin.
Table 2–10
shows the number of DQ pin groups per device.
DQ Pins
DQS Pin
DM Pin
Top, Bottom, Left, or Right I/O Bank
Table 2–10. DQ Pin Groups (Part 1 of 2)
Device
Package
Number of
×
8 DQ
Pin Groups
Total DQ Pin
Count
EP1C3
100-pin TQFP
(1)
3
24
144-pin TQFP
4
32
EP1C4
324-pin FineLine BGA
8
64
400-pin FineLine BGA
8
64
相關(guān)PDF資料
PDF描述
EP1C6F324C7ES Cyclone FPGA Family Data Sheet
EP1C6F324C8ES Cyclone FPGA Family Data Sheet
EP1C6F324I6ES Cyclone FPGA Family Data Sheet
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參數(shù)描述
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EP1C6Q240C7 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 FPGA - Cyclone I 598 LABs 185 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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