參數(shù)資料
型號： EP1C4T100I7
廠商： Altera Corporation
英文描述： Cyclone FPGA Family
中文描述： 氣旋FPGA系列
文件頁數(shù)： 86/94頁
文件大?。?/td> 1138K
代理商： EP1C4T100I7
86
Altera Corporation
Cyclone FPGA Family Data Sheet
Preliminary Information
Tables 59
through
64
show the adder delays associated with column and
row I/O pins for all packages. If an I/O standard is selected other than
LVTTL 24 mA with a fast slew rate, add the selected delay to the external
t
CO
and t
SU
I/O parameters shown in
Tables 44
through
47
.
Table 59. Cyclone I/O Standard Column Pin Input Delay Adders
I/O Standard
-6 Speed Grade
-7 Speed Grade
-8 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
LVCMOS
3.3-V LVTTL
2.5-V LVTTL
1.8-V LVTTL
1.5-V LVTTL
SSTL-3 class I
SSTL-3 class II
SSTL-2 class I
SSTL-2 class II
LVDS
0
0
28
214
326
221
221
264
264
197
0
0
30
235
358
244
244
291
291
217
0
0
ps
ps
ps
ps
ps
ps
ps
ps
ps
ps
33
256
391
266
266
317
317
237
Table 60. Cyclone I/O Standard Row Pin Input Delay Adders
I/O Standard
-6 Speed Grade
-7 Speed Grade
-8 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
LVCMOS
3.3-V LVTTL
2.5-V LVTTL
1.8-V LVTTL
1.5-V LVTTL
3.3-V PCI
(1)
SSTL-3 class I
SSTL-3 class II
SSTL-2 class I
SSTL-2 class II
LVDS
0
0
28
214
326
0
221
221
264
264
197
0
0
30
235
358
0
244
244
291
291
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0
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391
0
266
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317
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