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參數(shù)資料
| 型號： | EDD5108AFTA-7B-E |
| 廠商： | ELPIDA MEMORY INC |
| 元件分類： | DRAM |
| 英文描述： | 512M bits DDR SDRAM |
| 中文描述： | 64M X 8 DDR DRAM, 0.75 ns, PDSO66 |
| 封裝： | ROHS COMPLIANT, PLASTIC, TSOP2-66 |
| 文件頁數(shù)： | 9/48頁 |
| 文件大?。?/td> | 558K |
| 代理商： | EDD5108AFTA-7B-E |
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EDD5108AFTA-5, EDD5116AFTA-5
Data Sheet E0741E20 (Ver. 2.0)
9
Timing Parameter Measured in Clock Cycle
Number of clock cycle
tCK
5ns
Parameter
Symbol
min.
max.
Unit
Write to pre-charge command delay (same bank)
tWPD
4 + BL/2
—
tCK
Read to pre-charge command delay (same bank)
tRPD
BL/2
—
tCK
Write to read command delay (to input all data)
tWRD
2 + BL/2
—
tCK
Burst stop command to write command delay
tBSTW
3
—
tCK
Burst stop command to DQ High-Z
tBSTZ
3
3
tCK
Read command to write command delay
(to output all data)
tRWD
3 + BL/2
—
tCK
Pre-charge command to High-Z
tHZP
3
3
tCK
Write command to data in latency
tWCD
1
1
tCK
Write recovery
tWR
3
—
tCK
DM to data in latency
tDMD
0
0
tCK
Mode register set command cycle time
tMRD
2
—
tCK
Self refresh exit to non-read command
tSNR
15
—
tCK
Self refresh exit to read command
tSRD
200
—
tCK
Power down entry
tPDEN
1
1
tCK
Power down exit to command input
tPDEX
1
—
tCK
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EDD5108ADTA-6B | 512M bits DDR SDRAM |
| EDD5108ADTA-6BL | 512M bits DDR SDRAM |
| EDD5108ADTA-7A | 512M bits DDR SDRAM |
| EDD5108ADTA-7AL | 512M bits DDR SDRAM |
| EDD5108ADTA-7B | 512M bits DDR SDRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EDD5108AGTA | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:512M bits DDR SDRAM |
| EDD5108AGTA-4 | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:512M bits DDR SDRAM |
| EDD5108AGTA-4B-E | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:512M bits DDR SDRAM |
| EDD5108AGTA-4C-E | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:512M bits DDR SDRAM |
| EDD5108AGTA-5B-E | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:512M bits DDR SDRAM |
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