參數(shù)資料
型號： DSPIC33FJ12MC202T-I/SS
廠商： Microchip Technology
文件頁數(shù)： 39/155頁
文件大小： 0K
描述： IC DSPIC MCU/DSP 12K 28SSOP
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
標(biāo)準(zhǔn)包裝： 2,100
系列： dsPIC™ 33F
核心處理器： dsPIC
芯體尺寸： 16-位
速度： 40 MIP
連通性： I²C，IrDA，SPI，UART/USART
外圍設(shè)備： 高級欠壓探測/復(fù)位，電機控制 PWM，QEI，POR，PWM，WDT
輸入/輸出數(shù)： 21
程序存儲器容量： 12KB（12K x 8）
程序存儲器類型： 閃存
RAM 容量： 1K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x10b/12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-SSOP（0.209"，5.30mm 寬）
包裝： 帶卷 (TR)
dsPIC33FJ12MC201/202
DS70265E-page 24
2007-2011 Microchip Technology Inc.
REGISTER 3-2:
CORCON: CORE CONTROL REGISTER
U-0
R/W-0
R-0
—
—US
EDT(1)
DL<2:0>
bit 15
bit 8
R/W-0
R/W-1
R/W-0
R/C-0
R/W-0
SATA
SATB
SATDW
ACCSAT
IPL3(2)
PSV
RND
IF
bit 7
bit 0
Legend:
C = Clear only bit
R = Readable bit
W = Writable bit
-n = Value at POR
‘1’ = Bit is set
0’ = Bit is cleared
‘x = Bit is unknown
U = Unimplemented bit, read as ‘0’
bit 15-13
Unimplemented:
Read as ‘0’
bit 12
US:
DSP Multiply Unsigned/Signed Control bit
1
= DSP engine multiplies are unsigned
0
= DSP engine multiplies are signed
bit 11
EDT:
Early DO Loop Termination Control bit(1)
1
= Terminate executing DO loop at end of current loop iteration
0
= No effect
bit 10-8
DL<2:0>: DO
Loop Nesting Level Status bits
111
= 7 DO loops active
001
= 1 DO loop active
000
= 0 DO loops active
bit 7
SATA:
ACCA Saturation Enable bit
1
= Accumulator A saturation enabled
0
= Accumulator A saturation disabled
bit 6
SATB:
ACCB Saturation Enable bit
1
= Accumulator B saturation enabled
0
= Accumulator B saturation disabled
bit 5
SATDW:
Data Space Write from DSP Engine Saturation Enable bit
1
= Data space write saturation enabled
0
= Data space write saturation disabled
bit 4
ACCSAT:
Accumulator Saturation Mode Select bit
1
= 9.31 saturation (super saturation)
0
= 1.31 saturation (normal saturation)
bit 3
IPL3:
CPU Interrupt Priority Level Status bit 3(2)
1
= CPU interrupt priority level is greater than 7
0
= CPU interrupt priority level is 7 or less
bit 2
PSV:
Program Space Visibility in Data Space Enable bit
1
= Program space visible in data space
0
= Program space not visible in data space
bit 1
RND:
Rounding Mode Select bit
1
= Biased (conventional) rounding enabled
0
= Unbiased (convergent) rounding enabled
bit 0
IF:
Integer or Fractional Multiplier Mode Select bit
1
= Integer mode enabled for DSP multiply ops
0
= Fractional mode enabled for DSP multiply ops
Note 1:
This bit will always read as ‘0’.
2:
The IPL3 bit is concatenated with the IPL<2:0> bits (SR<7:5>) to form the CPU interrupt priority level.
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PDF描述
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參數(shù)描述
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