參數(shù)資料
型號： DSPIC33FJ128MC510-I/PT
廠商： Microchip Technology
文件頁數(shù)： 32/90頁
文件大?。?/td> 0K
描述： IC DSPIC MCU/DSP 128K 100TQFP
產(chǎn)品培訓模塊： dsPIC33F DMAC
Introduction to dsPIC33F Architecture Part 1
Asynchronous Stimulus
Introduction to dsPIC33F Architecture Part 2
特色產(chǎn)品： PIC24FJ/33FJ MCUs & dsPIC? DSCs
標準包裝： 119
系列： dsPIC™ 33F
核心處理器： dsPIC
芯體尺寸： 16-位
速度： 40 MIP
連通性： CAN，I²C，IrDA，LIN，SPI，UART/USART
外圍設備： 欠壓檢測/復位，DMA，電機控制 PWM，QEI，POR，PWM，WDT
輸入/輸出數(shù)： 85
程序存儲器容量： 128KB（128K x 8）
程序存儲器類型： 閃存
RAM 容量： 8K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 24x10b/12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-TQFP
包裝： 托盤
配用： 876-1001-ND - DSPIC33 BREAKOUT BOARD
AC164333-ND - MODULE SKT FOR PM3 100QFP
MA330013-ND - MODULE PLUG-IN DSPIC33 100TQFP
DV164033-ND - KIT START EXPLORER 16 MPLAB ICD2
DM240001-ND - BOARD DEMO PIC24/DSPIC33/PIC32
DV164005-ND - KIT ICD2 SIMPLE SUIT W/USB CABLE
dsPIC33F
DS70155C-page 36
Preliminary
2005 Microchip Technology Inc.
TABLE 9-5:
LOGIC INSTRUCTIONS
Assembly
Syntax
Description
Words
Cycles
AND
f {,WREG}
Destination = f .AND. WREG
1
AND
#lit10,Wn
Wn = lit10 .AND. Wn
1
AND
Wb,#lit5,Wd
Wd = Wb .AND. lit5
1
AND
Wb,Ws,Wd
Wd = Wb .AND. Ws
1
CLR
f
f = 0x0000
1
CLR
WREG
WREG = 0x0000
1
CLR
Wd
Wd = 0x0000
1
COM
f {,WREG}
Destination = f
11
COM
Ws,Wd
Wd = Ws
11
IOR
f {,WREG}
Destination = f .IOR. WREG
1
IOR
#lit10,Wn
Wn = lit10 .IOR. Wn
1
IOR
Wb,#lit5,Wd
Wd = Wb .IOR. lit5
1
IOR
Wb,Ws,Wd
Wd = Wb .IOR. Ws
1
NEG
f {,WREG}
Destination = f + 1
1
NEG
Ws,Wd
Wd = Ws + 1
1
SETM
f
f = 0xFFFF
1
SETM
WREG
WREG = 0xFFFF
1
SETM
Wd
Wd = 0xFFFF
1
XOR
f {,WREG}
Destination = f .XOR. WREG
1
XOR
#lit10,Wn
Wn = lit10 .XOR. Wn
1
XOR
Wb,#lit5,Wd
Wd = Wb .XOR. lit5
1
XOR
Wb,Ws,Wd
Wd = Wb .XOR. Ws
1
Note:
When the optional {,WREG} operand is specified, the destination of the instruction is WREG. When
{,WREG} is not specified, the destination of the instruction is the file register f.
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PDF描述
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