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參數資料
| 型號： | DSPIC30F6010A-30I/PT |
| 廠商： | Microchip Technology |
| 文件頁數： | 112/234頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSPIC MCU/DSP 144K 80TQFP |
| 產品培訓模塊： | dsPIC30F Quadrature Encoder Interface Serial Communications using dsPIC30F CAN Serial Communications using dsPIC30F I2C Serial Communications using dsPIC30F SPI Serial Communications using dsPIC30F UART dsPIC30F 12 bit ADC - Part 2 dsPIC30F Addressing Modes - Part 1 dsPIC30F Architecture - Part 1 dsPIC30F DSP Engine & ALU Asynchronous Stimulus dsPIC30F Addressing Modes - Part 2 dsPIC30F Architecture - Part 2 |
| 標準包裝： | 119 |
| 系列： | dsPIC™ 30F |
| 核心處理器： | dsPIC |
| 芯體尺寸： | 16-位 |
| 速度： | 30 MIP |
| 連通性： | CAN，I²C，SPI，UART/USART |
| 外圍設備： | 高級欠壓探測/復位，LVD，電機控制 PWM，QEI，POR，PWM，WDT |
| 輸入/輸出數： | 68 |
| 程序存儲器容量： | 144KB（48K x 24） |
| 程序存儲器類型： | 閃存 |
| EEPROM 大?。?/td> | 4K x 8 |
| RAM 容量： | 8K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.5 V ~ 5.5 V |
| 數據轉換器： | A/D 16x10b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 80-TQFP |
| 包裝： | 托盤 |
| 產品目錄頁面： | 651 (CN2011-ZH PDF) |
| 配用： | DM300019-ND - BOARD DEMO DSPICDEM 80L STARTER XLT80PT3-ND - SOCKET TRAN ICE 80MQFP/TQFP AC164320-ND - MODULE SKT MPLAB PM3 80TQFP AC30F007-ND - MODULE SKT FOR DSPIC30F 80TQFP DM300020-ND - BOARD DEV DSPICDEM MC1 MOTORCTRL DV164005-ND - KIT ICD2 SIMPLE SUIT W/USB CABLE |
| 其它名稱： | DSPIC30F6010A30IP |
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200
32099I–01/2012
AT32UC3L016/32/64
The oscillator is enabled by writing a one to the Enable bit in the 32kHz RC Oscillator Configura-
tion Register (RC32KCR.EN) and disabled by writing a zero to RC32KCR.EN. The oscillator is
also automatically enabled when the sampling mode is requested for the SM33. In this case,
writing a zero to RC32KCR.EN will not disable the RC32K until the sampling mode is no longer
requested.
13.5.13
Generic Clocks
Rev: 1.0.0.0
Timers, communication modules, and other modules connected to external circuitry may require
specific clock frequencies to operate correctly. The SCIF defines a number of generic clocks that
can provide a wide range of accurate clock frequencies.
Each generic clock runs from either clock source listed in the “Generic Clock Sources” table in
the SCIF Module Configuration section. The selected source can optionally be divided by any
even integer up to 512. Each clock can be independently enabled and disabled, and is also
automatically disabled along with peripheral clocks by the Sleep Controller in the Power
Manager.
Figure 13-6. Generic Clock Generation
13.5.13.1
Enabling a generic clock
A generic clock is enabled by writing a one to the Clock Enable bit (CEN) in the Generic Clock
Control Register (GCCTRL). Each generic clock can individually select a clock source by writing
to the Oscillator Select field (OSCSEL). The source clock can optionally be divided by writing a
one to the Divide Enable bit (DIVEN) and the Division Factor field (DIV), resulting in the output
frequency:
where f
SRC is the frequency of the selected source clock, and fGCLK is the output frequency of the
generic clock.
13.5.13.2
Disabling a generic clock
A generic clock is disabled by writing a zero to CEN or entering a sleep mode that disables the
PB clocks. In either case, the generic clock will be switched off on the first falling edge after the
disabling event, to ensure that no glitches occur. After CEN has been written to zero, the bit will
still read as one until the next falling edge occurs, and the clock is actually switched off. When
Divider
O SC SEL
Generic C lock
DIV
0
1
D IVEN
Mask
CEN
Sleep C ontroller
fSRC
fGCLK
G eneric
Clock
Sources
fGCLK
fSRC
2
DIV 1
+
()
----------------------------
=
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