參數(shù)資料
型號: DSP56855BUE
廠商: Freescale Semiconductor
文件頁數(shù): 33/52頁
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描述: IC DSP 16BIT 120MHZ 100-LQFP
標(biāo)準(zhǔn)包裝: 90
系列: 568xx
核心處理器: 56800E
芯體尺寸: 16-位
速度: 120MHz
連通性: EBI/EMI,SCI,SSI
外圍設(shè)備: DMA,POR,WDT
輸入/輸出數(shù): 18
程序存儲器容量: 48KB(24K x 16)
程序存儲器類型: SRAM
RAM 容量: 24K x 16
電壓 - 電源 (Vcc/Vdd): 1.62 V ~ 1.98 V
振蕩器型: 外部
工作溫度: -40°C ~ 85°C
封裝/外殼: 100-LQFP
包裝: 托盤
Enhanced Synchronous Serial Interface (ESSI) Timing
56855 Technical Data, Rev. 6
Freescale Semiconductor
39
Figure 4-25 Slave Mode Clock Timing
3. All the timings for the ESSI are given for a non-inverted serial clock polarity (TSCKP=0 in SCR2 and RSCKP=0 in SCSR)
and a non-inverted frame sync (TFSI=0 in SCR2 and RFSI=0 in SCSR). If the polarity of the clock and/or the frame sync have
been inverted, all the timings remain valid by inverting the clock signal SCK/SC0 and/or the frame sync SC2/SC1 in the tables
and in the figures.
4. 50 percent duty cycle
5. bl = bit length; wl = word length
tTHS
tTSS
tHS
tSS
tRFSWLS
tRFSWHS
tRFBLS
tRFSBHS
tTXHIS
tTXNVS
tFTXVS
tTXVS
tFTXES
tTXES
tTFSWLS
tTFSWHS
tTFSBLS
tTFSBHS
tSCKL
tSCKW
tSCKH
First Bit
Last Bit
SCK input
SC2 (bl) input
SC2 (wl) input
STD
SC0 input
SC1 (bl) input
SC1 (wl) input
SRD
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PDF描述
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