參數(shù)資料
型號(hào)： DS89C420-MCL
英文描述： Ultra-High-Speed Microcontroller
中文描述： 超高速微控制器
文件頁(yè)數(shù)： 49/59頁(yè)
文件大?。?/td> 539K
代理商： DS89C420-MCL
DS89C420
49 of 59
Note 1:
The system clock frequency is dependent on the oscillator frequency and the setting of the clock-divide control bits (CD1 and CD0) and the crystal
multiplier control bits (4X/
X
2
and CTM) in the PMR register. The term “1 / t
CLCL
” used in the variable timing table is calculated through the use
of the table given below.
4X/
X
1
0
X
X
X
2
CD1
CD0
NUMBER OF OSCILLATOR CYCLES
PER SYSTEM CLOCK (1 / t
CLCL
)
4 Oscillator Cycles
2 Oscillator Cycles
Reserved
1 Oscillator Cycle
1 / 1024 Oscillator Cycle
0
0
0
1
1
0
0
1
0
1
Note 2:
External MOVX instruction times are dependent on the setting of the MD2, MD1, and MD0 bits in the clock control register. The terms
“t
STC1
, t
STC2
,
t
STC3
” used in the variable timing table are calculated through the use of the table given below.
MD2
MD1
MD0
MOVX INSTRUCTION TIME
(MACHINE CYCLES)
2
3
4
5
9
10
11
t
STC1
(t
CLCL
)
0
2
6
10
14
18
22
t
STC2
(
t
CLCL
)
0
1
1
1
5
5
5
t
STC3
(
t
CLCL
)
0
0
0
0
4
4
4
t
STC4
(
t
CLCL
)
0
0
0
0
1
1
1
t
STC5
(
t
CLCL
)
0
1
1
1
1
1
0
0
0
0
1
1
1
0
0
0
1
0
1
0
1
0
1
1
0
0
1
1
1
1
1
12
26
5
4
1
1
Note 3:
Maximum load capacitance (to meet the above timing) for Port 0, ALE,
PSEN
,
WR
, and
RD
is limited to 60pF. Port 1, 2, 3, and 4
(except for P3.6,
WR
and P3.7,
RD
) are tested with a capacitance of 50pF. XTAL1 and XTAL2 load capacitance is dependent on
the frequency of the selected crystal.
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