參數(shù)資料
型號： DS5002FMN-16
英文描述： Secure Microprocessor Chip
中文描述： 安全微處理器芯片
文件頁數(shù)： 4/25頁
文件大?。?/td> 445K
代理商： DS5002FMN-16
DS5002FP Secure Microprocessor Chip
4 of 25
AC CHARACTERISTICS—EXPANDED BUS MODE TIMING SPECIFICATIONS
(V
CC
= 5V ±10%, T
A
= 0°C to +70°C.) (
Figure 1
and
Figure 2
)
#
PARAMETER
SYMBOL
1
Oscillator Frequency
1 / t
CLK
2
ALE Pulse Width
t
ALPW
3
Address Valid to ALE Low
t
AVALL
4
Address Hold After ALE Low
t
AVAAV
14
RD
Pulse Width
t
RDPW
15
WR
Pulse Width
t
WRPW
12MHz
16
RD
Low to Valid Data In
t
RDLDV
16MHz
17
Data Hold after
RD
High
t
RDHDV
18
Data Float after
RD
High
t
RDHDZ
12MHz
19
ALE Low to Valid Data In
t
ALLVD
16MHz
12MHz
20
Valid Address to Valid Data In
t
AVDV
16MHz
21
ALE Low to
RD
or
WR
Low
t
ALLRDL
Address Valid to
RD
or
WR
Low
23
Data Valid to
WR
Going Low
t
DVWRL
12MHz
24
Data Valid to
WR
High
t
DVWRH
16MHz
25
Data Valid after
WR
High
t
WRHDV
26
RD
Low to Address Float
t
RDLAZ
27
RD
or
WR
High to ALE High
t
RDHALH
Figure 1. Expanded Data Memory Read Cycle
CONDITIONS
MIN
1.0
MAX
16
5t
CLK
- 165
5t
CLK
- 105
2t
CLK
- 70
8t
CLK
- 150
8t
CLK
- 90
9t
CLK
- 165
9t
CLK
- 105
3t
CLK
+ 50
UNITS
MHz
ns
ns
ns
ns
ns
2t
CLK
- 40
t
CLK
- 40
t
CLK
- 35
6t
CLK
- 100
6t
CLK
- 100
0
3t
CLK
- 50
ns
ns
ns
ns
ns
ns
22
t
AVRDL
4t
CLK
- 130
ns
t
CLK
- 60
7t
CLK
- 150
7t
CLK
- 90
t
CLK
-50
t
CLK
- 40
ns
ns
ns
ns
ns
0
t
CLK
+ 50
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